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ADSP-BF561
SDRAM接口时序
表20. SDRAM接口时序
参数
时序要求
t
SSDAT
数据建立CLKOUT前
t
HSDAT
数据保持CLKOUT后
开关特性
t
DCAD
命令， ADDR ，数据延迟CLKOUT后
1
命令， ADDR ，数据保持CLKOUT后
1
t
HCAD
t
DSDAT
数据禁止CLKOUT后
t
ENSDAT
数据使能CLKOUT后
t
SCLK
CLKOUT周期
t
SCLKH
CLKOUT宽高
t
SCLKL
CLKOUT宽度低
1
民
1.5
0.8
最大
单位
ns
ns
4.0
0.8
4.0
1.0
7.5
2.5
2.5
ns
ns
ns
ns
ns
ns
ns
命令引脚包括： SRAS ， SCAS ， SWE ， SDQM ， SMS3-0 ， SA10 ， SCKE 。
t
SDCLK
SDCLK
t
SDCLKH
t
SSDAT
t
HSDAT
t
SDCLKL
数据（IN）的
t
DCAD
t
ENSDAT
数据（OUT ）
t
DSDAT
t
HCAD
t
DCAD
CMND ADDR
（下）
t
HCAD
图12. SDRAM接口时序
修订版E |
第26页64 |
2009年9月
