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R
XC4000E和XC4000X系列现场可编程门阵列
快速进位逻辑
每个CLB F和G函数发生器包含专用
为迅速生成进位和借位的算术逻辑
信号。这种额外的输出被传递给函数gen-
员在相邻的CLB 。进位链是独立
正常的布线资源。
专用快速进位逻辑极大地提高了EF网络效率
和的加法器，减法器，累加器性能
比较器和计数器。这也开启了大门，许多
涉及算术运算，其中的新的应用程序
前几代的FPGA都不够快或过
低效率。高速的地址偏移量计算，微
处理器或图形系统，和高速加法
数字信号处理是两个典型的应用程序。
两个4输入函数发生器可以是CON组fi gured作为
2位加法器，内置隐藏携带，可以说扩大
到任意长度。这种专用的进位电路的这么快，
英法fi cient常规的加速方法，如随身携带
生成/传播是无意义的，即使在16位的
级和，边际好处音响吨的32位的水平。
这种快速进位逻辑是比较显着的特征之一
在XC4000系列，加快算术和计数
到70 MHz范围内。
在XC4000E器件的进位链可以运行或
下来。在列的顶部和底部，其中有
高于或低于无CLB中，进位传播到
对。 （见
图11. ）
为了提高速度，在
高容量XC4000X器件，它可以潜在地
有很长的进位链，进位链向上行进
只，如图
图12 。
此外，标准在互连
NECT可用于路由的进位信号在向下
方向。
图13第19页
显示了XC4000E CLB与德迪
cated快速进位逻辑。在XC4000X进位逻辑
类似的，不同之处在于COUT出口处仅顶端，并且显
纳尔CINDOWN不存在。如图
图13中的
该
进行逻辑运算的股份和控制输入的功能
化发电机。的进位输出端连接到所述功能
发电机，在那里它们被结合的操作数
形成的款项。
图14第20页
示出的进位逻辑电路的细节
为XC4000E 。此图显示的内容
盒标有“进位逻辑”
图13 。
该XC4000X
进位逻辑是很相似的，但在一个多路转换器
直通进位链已经被淘汰，以减少
延时。另外，在XC4000X上的多路转换器
G4路径具有记忆可编程输入0 ，这per-
MITS G4直接连接到COUT 。 G4从而成为
另外高速初始化路径随身而定。
专用进位逻辑中详细讨论赛灵思
文档XAPP 013 ： “使用
在专用进位逻辑
XC4000.”
这一讨论同样适用于XC4000E
的设备，并XC4000X设备时次要逻辑
的变化都考虑在内。
快速进位逻辑可以通过将特殊访问
库符号，或者利用Xilinx相关法放置巨
ROS （ RPM包）已经包含这些符号。
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
X6687
图11 ：可用XC4000E进位传播
路径
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
CLB
X6610
图12 ：可用XC4000X进位传播
路径（虚线使用通用的互连）
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1999年5月14日（版本1.6 ）
