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R
的Spartan- II FPGA系列：功能描述。
使用Block RAM功能
了Spartan- II FPGA系列提供了专用模块
片上，真正的双读/写端口同步RAM ，用
4096的存储器单元。块RAM内存的每个端口
可以独立地配置为读/写端口，一个
读端口，一个写端口，和可以被配置为一个特定
数据宽度。块RAM内存提供的新功能
让FPGA设计人员简化设计。
基元库
图31
和
图32
显示两个通用库块
RAM基元。
表11
描述了所有可用的
原语进行综合和仿真。
RAMB4_S#_S#
WEA
ENA
RSTA
CLKA
ADDRA [ ＃ ： 0 ]
DIA [ ＃ ： 0 ]
操作模式
块RAM内存支持两种工作模式。
阅读
回写
DOA [ ＃ ： 0 ]
阅读（一个时钟沿）
的读出地址被登记在所述读端口时钟边沿
和数据显示在RAM存取时间后的输出。
有些记忆可能将锁存器/寄存器的输出
根据渴望拥有更快的时钟到输出与
设置时间。这通常被认为是较差的
由于溶液改变读操作的
失踪的可能性异步函数
的生成过程中的地址/控制线过渡
读脉冲时钟。
WEB
ENB
RSTB
CLKB
ADDRB [ ＃ ： 0 ]
DIB [＃ ：0]
DOB [ ＃ ： 0 ]
DS001_31_061200
图31 ：
双端口块RAM内存
RAMB4_S#
WE
EN
RST
CLK
ADDR [ ＃ ：0]
DI [ ＃ ： 0 ]
DS001_32_061200
DO [ ＃ ： 0 ]
回写（一个时钟沿）
写地址被登记在所述写端口时钟边沿
和数据输入写入到存储器和镜像
的写端口的输入。
图32：
单端口Block RAM内存
表11：
可用基元库
原始
RAMB4_S1
RAMB4_S1_S1
RAMB4_S1_S2
RAMB4_S1_S4
RAMB4_S1_S8
RAMB4_S1_S16
RAMB4_S2
RAMB4_S2_S2
RAMB4_S2_S4
RAMB4_S2_S8
RAMB4_S2_S16
A口宽度
1
B口宽度
不适用
1
2
4
8
16
不适用
2
4
8
16
块RAM特点
1.所有输入都注册到端口的时钟，并具有
设置时钟时序规范。
2.所有输出都通过一个读或写回功能
根据端口WE管脚的状态。输出
相对于时钟端口可用后
时钟到输出的时序规范。
3块RAM是真正的SRAM存储器和不
有从地址到一个组合路径
输出。 LUT的细胞在CLB中仍然可用以
此功能。
4.端口是完全独立于彼此
（即，时钟，控制，地址，读/写功能，并且
数据宽度）没有仲裁。
5.写操作只需要一个时钟沿。
6.读操作只需要一个时钟沿。
输出端口被锁存具有自定时电路，以
保证无故障读。输出端口的状态将
直到端口执行另一次读不会改变或写
操作。
2
DS001-2 （ V2.8 ） 2008年6月13日
产品speci fi cation
www.xilinx.com
4模块2
32
