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PSD4256G6V
PLDS
在可编程逻辑器件带来可编程逻辑的功能
到PSD 。指定逻辑的可编程逻辑器件后
使用PSDsoft中，该逻辑被编程到
设备和提供上电时。
该PSD包含两个可编程逻辑器件：译码PLD
（ DPLD ）和复杂可编程逻辑器件（CPLD） 。在可编程逻辑器件
在接下来的几个段落进行了简要论述，
并在以下各节中更详细地。身材
12 ，第39页显示了可编程逻辑器件的配置。
该DPLD进行内部地址译码
组件，例如存储器，寄存器和I / O的
端口选择信号。
CPLD的可用于逻辑功能，如
可装载计数器和移位寄存器，状态马
。中国，和编码和解码逻辑。这些
的逻辑功能可以用16来构造
输出宏单元（ OMC ） ， 24输入宏单元
（IMC） ，和与数组。 CPLD的也可以是
用于生成外部片选（ ECS0-
ECS2 ）信号。
与门阵列被用来形成乘积项。
这些产品的术语使用PSDsoft中指定。
一个输入总线包括82的信号连接
在可编程逻辑器件。该信号示于表32 。
在PSD睿频位
在可编程逻辑器件中的PSD4256G6V可以最大限度地减少pow-
呃消费转向在 - 待机时
看跌不变的延长时间
大约为70ns 。的重置涡轮位为“0” （第3位
在PMMR0寄存器）自动放置
可编程逻辑器件进入待机状态，如果没有输入正在发生变化。开启
荷兰国际集团的Turbo模式关闭增加DE-传播
同时降低能耗奠定。见
一节题为“电源管理” ，就
第70页，关于如何设置的涡轮增压位。
另外， 5位是在PMMR2可用
注册到进入阻止MCU的控制信号
在可编程逻辑器件。这降低了功耗和
可以使用只有当这些微控制器的控制信号
未在PLD逻辑方程中使用。
每两个可编程逻辑器件具有独特的特点
适合的应用。它们被描述在
以下各节。
表32. DPLD和CPLD输入
输入源
MCU地址总线
(1)
MCU控制信号
RESET
掉电
端口A的输入
宏单元
端口B输入
宏单元
端口C输入
宏单元
端口D投入
端口F输入
页寄存器
宏小区的反馈
宏单元B反馈
FL灰内存
程序状态字
输入名称
A15-A0
CNTL0-CNTL2
RST
PDN
PA7-PA0
PB7-PB0
PC7-PC0
PD3-PD0
PF7-PF0
PGR7-PGR0
MCELLA.FB7-FB0
MCELLB.FB7-FB0
就绪/忙
数
of
信号的
16
3
1
1
8
8
8
4
8
8
8
8
1
注：1。地址输入A19 - A4在80C51XA模式。
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这是对正在开发或正在接受评估新产品的初步信息。详细信息如有变更，恕不另行通知。
