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PI6C48533-01
3.3V低偏移1至4
差分/ LVCMOS至LVPECL扇出缓冲器
应用信息
接线differenctial输入接受单端水平
图1示出了如何将差分输入可连接到接受单端电平。参考电压V_REF = V
DD
/ 2是
由偏置电阻器R1, R2和C1产生的。此偏置电路应位于尽可能接近到输入引脚。的比率
R1和R2可能需要在输入电压摆动的中心被调整为位式的V_REF 。例如,如果输入的时钟
秋千是只有2.5V和V
DD
= 3.3V , V_REF应该是1.25V和R1 / R2 = 0.609 。
V
DD
单端
时钟输入
R1
1K
CLK1
nCLK1
C1
0.1
R2
1K
图2 :单端信号驱动差分输入
6
PS8737B
02/08/06

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