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军队的ProASIC3 / EL低功耗快闪FPGA
表2-35
I / O输出缓冲区的最大阻力
1
适用于高级I / O组的A3P1000只有
标准
3.3 V LVTTL / 3.3 V LVCMOS
驱动强度
2毫安
4毫安
6毫安
8毫安
12毫安
16毫安
24毫安
2.5 V LVCMOS
2毫安
4毫安
6毫安
8毫安
12毫安
16毫安
24毫安
1.8 V LVCMOS
2毫安
4毫安
6毫安
8毫安
12毫安
16毫安
1.5 V LVCMOS
2毫安
4毫安
6毫安
8毫安
12毫安
3.3 V的PCI / PCI -X
注意事项：
提供1。这些最大值仅用于提供信息的理由。最小输出缓冲性
值取决于V
CCI
，驱动强度，温度和工艺。对于电路板设计考虑
而详细的输出缓冲电阻，使用位于Actel的网站上相应的IBIS模型
http://www.actel.com/download/ibis/default.aspx 。
2. R
（ PULL - DOWN- MAX ）
= (V
OLspec
) / I
OLspec
3. R
（ PULL - UP- MAX ）
= (V
CCImax
– V
OHspec
) / I
OHS PE
每个PCI / PCI -X
规范
R
下拉
(Ω)
2
100
100
50
50
25
17
11
100
100
50
50
25
17
11
100
100
50
50
25
20
200
100
67
33
33
25
R
引体向上
(Ω)
3
300
300
150
150
75
50
33
300
300
150
150
75
50
33
200
200
100
100
50
40
224
112
75
37
37
75
v1.0
2 - 33
