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ISL98003
引脚
ISL98003
（ 80 LD EPTQFP ）
顶视图
G0
G1
G2
V
D1.8
G3
G4
G5
G6
G7
V
D3.3
B0
B1
B2
V
D1.8
B3
B4
B5
B6
B7
V
D3.3
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
43
44
43
42
41
V
D3.3
R7
R6
R5
R4
R3
V
D1.8
R2
R1
R0
V
D3.3
DATACLK
DATACLK
HS
OUT
HSYNC
OUT
VSYNC
OUT
INT
DE
场
TEST
OUT
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
DTEST5
DTEST4
XCLK
OUT
V
D1.8
SCL
SDA
COAST
IN
钳
IN
RESET
CLOCKINV
IN
DTEST3
EXTCLK
IN
DTEST2
HSYNC
IN
0
VSYNC
IN
0
HSYNC
IN
1
VSYNC
IN
1
DTEST1
VPLL
D1.8
XTAL
OUT
GND
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20
引脚说明
符号
R
IN
0, 1
G
IN
0, 1
B
IN
0, 1
VREF
红
,
VREF
绿色
,
VREF
蓝
SOG
IN
0, 1
HSYNC
IN
0, 1
描述
模拟输入。红色通道。交流耦合至0.1μF 。
模拟输入。开辟绿色通道。交流耦合至0.1μF 。
模拟输入。蓝色通道。交流耦合至0.1μF 。
模拟输入。参考电压的ADC 。绑到1.8V的参考电压（V
A1.8
是可以接受的，如果低噪音） 。与去耦
0.1μF的电容到GND
A
.
模拟输入。绿同步。通过一个0.01μF的电容串联连接到相应的绿色通道视频源
一个500Ω的电阻。
数字
高阻抗
3.3V输入， 240mV的滞后。连接到相应通道的HSYNC来源。对于5V
信号划分了1K / 1.9K分频器输入。将分频器尽可能靠近器件的引脚。放置一个50pF的电容
与1k电阻并联，以减少除法器的过滤效果。
数字
高阻抗
3.3V输入， 240mV的滞后。连接到相应通道的VSYNC来源。对于5V
信号划分了1K / 1.9K分频器输入。将分频器尽可能靠近器件的引脚。放置一个50pF的电容
与1k电阻并联，以减少除法器的过滤效果。
数字3.3V输入。当此输入为高，外部海岸被选中时，PLL将海岸，忽略所有过渡
激活通道的HSYNC / SOG 。
VSYNC
IN
0, 1
COAST
IN
7
V
A1.8
V
A3.3
VREF
红
V
A1.8
V
A3.3
B
IN1
G
IN1
VREF
绿色
SOG
IN1
V
A1.8
R
IN1
B
IN0
V
A3.3
G
IN0
SOG
IN0
VREF
蓝
R
IN0
VADC
D1.8
VPLL
A3.3
XTAL
IN
GND地连接至裸露焊盘
FN6760.0
2008年9月12日
