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注册240PIN DDR2 SDRAM DIMM内存模块
电气特性&交流时序
速箱和CL ， tRCD的，激进党，真相与和解委员会tRAS的相应斌
速度
彬（ CL - tRCD的-TRP ）
参数
CAS延迟
tRCD的
激进党
TRC
tRAS的
DDR2-800 （ S5）中
5-5-5
民
5
12.5
12.5
57.5
45
DDR2-667 （ Y5 ）
5-5-5
民
5
15
15
60
45
DDR2-533 （C4）的
4-4-4
民
4
15
15
60
45
单位
ns
ns
ns
ns
ns
由速度等级AC时序参数（ DDR2-400 & DDR2-533 ）
DDR2-400
参数
数据输出边缘到时钟边沿斜
DQS -出边缘时钟边沿斜
时钟高电平宽度
时钟低电平宽度
时钟半周期
系统时钟周期
DQ和DM输入建立时间
DQ和DM输入保持时间
控制&地址输入脉冲宽度为每个输入
DQ和DM输入脉冲宽度为每个输入脉冲宽度为
每个输入
从CK数据输出高阻抗窗口， / CK
从CK / CK DQS低阻抗时间
从CK / CK DQ低阻抗时间
DQS -DQ歪斜的DQS和相关DQ信号
DQ举行倾斜因子
从DQS DQ / DQS输出保持时间
写命令到第一个DQS闭锁过渡
DQS输入高电平脉冲宽度
DQS输入低脉冲宽度
DQS下降沿到CK建立时间
DQS从CK下降沿保持时间
模式寄存器设置命令周期时间
写序言
DDR2-533
单位注
民
-500
-500
0.45
0.45
民
（ TCL ， TCH）
3750
100
225
0.6
0.35
-
TAC分钟
2 * TAC分钟
-
-
THP - TQHS
WL - 0.25
0.35
0.35
0.2
0.2
2
0.35
符号
民
TAC
tDQSCK
总胆固醇
TCL
THP
TCK
TDS
TDH
tIPW
tDIPW
太赫兹
TLZ （ DQS ）
TLZ （DQ）
TDQSQ
TQHS
tQH
tDQSS
tDQSH
tDQSL
TDSS
tDSH
超过tMRD
tWPRE
-600
-500
0.45
0.45
民
（ TCL ， TCH）
5000
150
275
0.6
0.35
-
TAC分钟
2 * TAC分钟
-
-
THP - TQHS
WL - 0.25
0.35
0.35
0.2
0.2
2
0.35
最大
600
500
0.55
0.55
-
8000
-
-
-
-
TAC最大
TAC最大
TAC最大
350
450
-
WL + 0.25
-
-
-
-
-
-
最大
500
450
0.55
0.55
-
8000
-
-
-
-
TAC最大
TAC最大
TAC最大
300
400
-
WL + 0.25
-
-
-
-
-
-
ps
ns
CK
CK
ns
ps
ps
ps
TCK
TCK
ps
ps
ps
ps
ps
ps
TCK
TCK
TCK
TCK
TCK
TCK
TCK
1
1
修订版0.3 / 2008年10月
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