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CY8C24123A
CY8C24223A ， CY8C24423A
AC电气特性
AC芯片级规范
下表列出了许可的最大和最小规格的电压和温度范围： 4.75V到5.25V
和-40°C
≤
T
A
≤
85°C ， 3.0V至3.6V和-40°C
≤
T
A
≤
85°C ，或2.4V至3.0V以及-40°C
≤
T
A
≤
85°C ，分别。典型参数
适用于5V ， 3.3V和25°C时为2.7V ，并仅作为设计参考。
表31. 5V和3.3V交流芯片级规范
符号
F
IMO24
F
IMO6
F
CPU1
F
CPU2
F
48M
F
24M
F
32K1
F
32K2
F
PLL
描述
内部主振荡器频率
24兆赫
内部主振荡器频率
6兆赫
CPU频率（标称5V ）
CPU频率（ 3.3V标称）
数字模块频率
数字模块频率
内部低速振荡器
频率
外部晶体振荡器
PLL频率
民
23.4
典型值
24
最大
单位
笔记
24.6
[10,11,12]
兆赫修剪5V或3.3V工作电压
使用出厂预设值。看
科幻gure
12
第17页SLIMO模式= 0 。
[10,11,12]
兆赫修剪5V或3.3V工作电压
6.35
使用出厂预设值。看
科幻gure
12
第17页SLIMO模式= 1 。
24.6
[10,11]
兆赫
[11,12]
12.3
兆赫
49.2
[10,11,13]
MHz的参考数字模块的交流
特定连接的阳离子。
24.6
[11,13]
兆赫
64
千赫
–
–
600
10
50
2620
3800
精度电容和晶振
依赖。占空比为50％ 。
兆赫晶体的倍数（ x732 ）
频率。
ps
ms
ms
ms
ms
千赫
5.75
6
0.93
0.93
0
0
15
–
–
–
0.5
0.5
–
–
24
12
48
24
32
32.768
23.986
–
–
–
1700
2800
Jitter24M2 24 MHz的周期抖动（PLL）的
T
PLLSLEW
PLL锁定时间
T
PLLSLEWSL
PLL锁定时间为Low Gain设置
OW
T
OS
T
OSACC
外部晶体振荡器启动至1 ％
外部晶体振荡器启动以
100 ppm的
晶体振荡器的频率是
内为100ppm其最终值由
将n的端
OSACC
期。正确
操作假定正确
装1微瓦的最大驱动电平
32.768 kHz晶振。 3.0V
≤
VDD
≤
5.5V, -40
o
C
≤
T
A
≤
85
o
C.
Jitter32k
T
XRST
DC24M
Step24M
Fout48M
Jitter24M1P
32 kHz的周期抖动
外部复位脉冲宽度
24 MHz的占空比
24 MHz的微调步长
48 MHz输出频率
24 MHz的周期抖动（ IMO）
峰 - 峰值
Jitter24M1R 24 MHz的周期抖动（ IMO）均方根
平方
F
最大
信号对行最大频率
输入或行输出。
T
坡道
供应减速时间
–
10
40
–
46.8
–
–
–
0
100
–
50
50
48.0
300
–
–
–
–
60
–
49.2
[10,12]
ns
μs
%
千赫
兆赫修整。使用出厂预设值。
ps
ps
兆赫
μs
600
12.3
–
笔记
10. 4.75V <的Vdd < 5.25V 。
11.精度源自内部主振荡器的适当修整为Vdd的范围。
12. 3.0V <的Vdd < 3.6V 。请参阅应用笔记
AN2012
在微调操作“调整PSoC微控制器修剪为双电压范围运行”的信息
在3.3V 。
13.参见具体用户模块数据表上的最大频率的用户模块的信息。
文件编号： 38-12028牧师*
第31页55
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