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CY8C24123A
CY8C24223A ， CY8C24423A
表48.交流了我的特点
2
SDA和SCL引脚为Vdd的> 3.0V
（续）
符号
T
SUSTOI2C
T
BUFI2C
T
SPI2C
描述
停止条件建立时间
一个停止和启动条件之间的总线空闲时间
尖峰脉冲宽度由输入滤波器被抑制。
标准模式
民
4.0
4.7
–
最大
–
–
–
快速模式
民
0.6
1.3
0
最大
–
–
50
单位
μs
μs
ns
表49.交流了我的特点
2
SDA和SCL引脚为Vdd的
＆ LT ;
3.0V （快速模式不支持）
符号
F
SCLI2C
T
HDSTAI2C
T
LOWI2C
T
HIGHI2C
T
SUSTAI2C
T
HDDATI2C
T
SUDATI2C
T
SUSTOI2C
T
BUFI2C
T
SPI2C
SCL时钟频率
保持时间（重复）启动条件。在此期限之后，在
第一个时钟脉冲。
SCL时钟的低电平周期
高周期的SCL时钟
对于重复的起始条件建立时间
数据保持时间
数据建立时间
停止条件建立时间
一个停止和启动条件之间的总线空闲时间
尖峰脉冲宽度由输入滤波器抑制
描述
标准模式
民
0
4.0
4.7
4.0
4.7
0
250
4.0
4.7
–
最大
100
–
–
–
–
–
–
–
–
–
快速模式
民
–
–
–
–
–
–
–
–
–
–
最大
–
–
–
–
–
–
–
–
–
–
单位
千赫
μs
μs
μs
μs
μs
ns
μs
μs
ns
图22.时序定义在我快速/标准模式
2
C总线
SDA
T
LOWI2C
T
SUDATI2C
T
HDSTAI2C
T
SPI2C
T
BUFI2C
SCL
S T
HDSTAI2C
T
HDDATI2C
T
HIGHI2C
T
SUSTAI2C
Sr
T
SUSTOI2C
P
S
文件编号： 38-12028牧师*
第43页55
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