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图1-1 。
框图
2.引脚配置
表2-1 。
引脚名称
CLK
IN
I / O
GND
VCC
引脚配置（所有引脚分布俯视图）
功能
时钟
逻辑输入
双向缓冲器
地
（ 3 5.5V ）电源
图2-1 。
CLK / IN
IN
IN
IN
IN
IN
IN
IN
IN
IN
IN
GND
TSSOP
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
VCC
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
IN
图2-2 。
DIP / SOIC
CLK / IN
IN
IN
IN
IN
IN
IN
IN
IN
IN
IN
GND
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
VCC
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
IN
注意：
TSSOP最小封装的SPLD
招股。
图2-3 。
PLCC
IN
IN
CLK / IN
VCC *
VCC
I / O
I / O
4
3
2
1
28
27
26
注意：
用于PLCC，引脚1,8 ，15，和22可以是
悬空。优越的perfor-
曼斯，连接到VCC引脚1和GND
到销8 ，15，和22 。
2
ATF22LV10C(Q)Z
0779L–PLD–12/05
IN
IN
GND
GND *
IN
I / O
I / O
12
13
14
15
16
17
18
IN
IN
IN
GND *
IN
IN
IN
5
6
7
8
9
10
11
25
24
23
22
21
20
19
I / O
I / O
I / O
GND *
I / O
I / O
I / O
