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IGLOOe低功耗快闪FPGA
全局时钟
IGLOOe设备有多个时钟域的广泛支持。除CCC和
PLL支持如上所述，有一个综合的全局时钟分配网络。
每一个通用的输入和输出端口可以访问九VersaNets ： 6片（主）和三个
象限全球网络。该VersaNets可由CCC或直接驱动从所选取的
通过多路复用器（多路复用器）的核心。该VersaNets可用于分发低偏移时钟信号或
高扇出网快速分发。
临I / O的高级I / O标准
该IGLOOe系列FPGA具有灵活的I / O结构，支持的电压范围（ 1.2 V，
1.5 V， 1.8 V ， 2.5 V和3.3 V ） 。 IGLOOe FPGA支持19种不同的I / O标准，包括单
结束，差分和电压参考。在I / O的组织到银行， 8家银行
每台设备（每侧两个） 。这些银行的配置决定了I / O标准
支持。每个I / O组细分为V
REF
minibanks ，用于由电压参考
I / O操作。 V
REF
minibanks包含8至18个I / O 。所有的I / O中的一个给定的minibank共享一个普通V
REF
线。
因此，如果任何的I / O中的一个给定的V
REF
minibank配置为V
REF
销，其余的I / O在该
minibank将能够使用该参考电压。
每个I / O模块包含多个输入，输出和使能寄存器。这些寄存器允许
执行以下操作：
单倍数据速率应用（例如，PCI 66MHz的，双向的SSTL 2和3中， I类和II）
双数据速率应用（例如， DDR LVDS ，B LVDS和M-LVDS I / O进行点至点
通信和DDR 200采用双向HSTL II类兆赫SRAM ） 。
IGLOOe银行支持M- LVDS与20多丢分。
v1.2
1-7
