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SLWS211B - 2008年7月 - 修订2008年10月
典型特征 - 常见PLOTS
所有地块都在25 ° C， AVDD = 3.3 V ， DRVDD = 1.8 V ，最大额定采样频率，正弦波输入时钟。 1.5 V
PP
差分时钟的幅度， 50 ％时钟占空比， -1 dB的差分模拟输入，内部基准模式，0 dB增益，
LVDS输出接口（除非另有说明）
CMRR
vs
输入频率
0
10
20
P - 总功率 - 含
30
CMRR - 分贝
40
50
60
70
80
90
100
0
20
40
60
80
100
G079
总功率
vs
采样频率
1.0
0.9
0.8
0.7
0.6
0.5
0.4
0.3
0.2
0.1
0.0
0
50
100
150
200
250
G077
C
L
= 10 pF的
LVDS
CMOS
f
IN
- 输入频率 - MHz的
f
S
- 采样频率 - MSPS
图89 。
DRVDD电流
vs
采样频率
100
I
DRVDD
- DRVDD电流 - 毫安
90
80
70
60
50
40
30
20
10
0
0
50
100
150
200
250
G078
图90 。
f
IN
= 3兆赫
C
L
= 10 pF的
LVDS
CMOS
OE停用
f
S
- 采样频率 - MSPS
图91 。
2008 ，德州仪器
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