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SLAS610C - 2008年8月 - 修订2009年10月

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时钟输入

该ADS548x等效时钟输入电路示于

图37 。

时钟输入可以被驱动以任一

差分时钟信号或单端时钟输入，但差动强烈建议。表征

该ADS548x的通常与3 -V进行

PP

差分时钟，但ADC具有差分运行良好

时钟幅度下降到 1 V

PP

，如图

图39

和

图40

。的性能进行了优化时的

时钟振幅保持高于2 V

PP

。时钟振幅变为更多倍的性能，因为

模拟输入频率的增加。当单端时钟是必要的，最好是CLKM连接

地面有0.01 μF的电容，而CLKP是交流耦合与0.01 μF电容的时钟源，如

所示

图38 。

图37.时钟输入电路

方波或

正弦波

0.01

m

F

ADS548x

CLKM

0.01

m

F

CLKP

S0168-08

图38.单端时钟

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