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HiRel它SX -A系列FPGA
数据表信息
变动一览
下面的表列出了在该文档的当前版本中所做的关键变化。
以前的版本
先进的1.2版
（ 2002年12月）
改变当前版本V2.0
84引脚CQFP封装信息添加到数据表。
该产品计划表被删除，因为所有的器件都生产设备。
表1-6 绝对最大Ratings1
进行了更新，包括V
CCA
交流电源电压
信息。此外，两个音符被添加到表中。
注1和2分别加入
表1-8 3.3 V LVTTL和5 V TTL电气规格。
该
"HiRel SX -A定时Model"
已更新。
该
"Hardwired Clock"
和
"Routed Clock"
方程进行了更新。
所有的时序特性表进行更新，因为要包括完全表征
数据。
先进的1.1版
表1-8 3.3 V LVTTL和5 V TTL电气规格
已更新。
表1-12 DC规格， 3.3 V PCI操作
已更新。
初步V1.0
该
"Ordering Information"节
已更新。
图1-1 HiRel它SX -A系列互连元件
已更新。
该
"Clock Resources"节
已更新。
该
"I / O Modules"节
已更新。
表1-2 I / O特性
已更新。
该
"Hot - Swapping"节
已更新。
表1-3 I / O特性的所有I / O配置
是新的。
表1-4 电时间在其I / O的变得活跃
是新的。
该
"Power Requirements"节
已更新。
该
"Design Considerations"节
已更新。
图1-10 探头设置
已更新。
表1-6 绝对最大Ratings1
已更新。
表1-7 推荐工作条件
已更新。
表1-9 最大源和吸收电流为所有的I / O标准
是新的。
图1-15 HiRel它SX -A时序模型
已更新。
该
"Pin Description"节
已更新。
页面
不适用
不适用
1-10
1-11
1-17
1-17
不适用
1-11
1-14
ii
1-1
1-5
1-6
1-6
1-7
1-6
1-7
1-7
1-8
1-8
1-10
1-10
1-11
1-17
1-31
v2.0
3-1
