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40MX和42MX FPGA系列
JTAG模式激活
JTAG测试逻辑电路的设计启动
软件选择工具->设备选择。这
会弹出设备选型对话框，如图
图1-15 。
在JTAG测试逻辑电路可通过使能
点击"Reserve JTAG Pins"复选框。
表5
解释了标签“在任一模式下的行为。
图1-15
设备选择向导
表5
边界扫描引脚配置和功能
检查
BST输入;必须终止逻辑高或低，以避免浮
BST输入;可漂浮或绑到高
BST输出;可能是浮动的或可连接到另一个设备的TDI的
选中
用户I / O
用户I / O
用户I / O
储备JTAG
TCK
TDI ， TMS
TDO
TRST引脚和TAP控制器复位
一个有效复位（ TRST ）引脚不支持;但是， MX
器件包含上电电路，复位
在上电时的边界扫描电路。另外，在TMS
销配备有一个内部上拉电阻。这
允许TAP控制器将保持在或返回到
测试逻辑复位状态，当没有输入或当
逻辑1是在TMS管脚上。要复位控制器， TMS
必须为高电平至少五TCK周期。
边界扫描描述语言
（ BSDL ）文件
符合IEEE标准1149.1规定，
各种JTAG组件的操作是
记录在案。该BSDL文件提供的标准格式
描述可以使用的由JTAG部件
自动测试设备软件。该文件包括
所支持的指令，指令的位模式，
和边界扫描链的顺序。对于进行了深入
上BSDL文件的讨论，请参考
Actel的BSDL文件
格式说明
应用笔记。
Actel的BSDL文件被分为两类 -
通用的和特定于设备的。通用文件分配所有
用户I / O的inouts 。设备特定文件指定用户I / O为
输入，输出或inouts 。
可在Actel的网站MX设备通用文件
at
http://www.actel.com/techdocs/models/bsdl.html 。
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v6.0
