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40MX和42MX FPGA系列
表29
A40MX02时序特性（标称值为3.3V操作） （续）
（最坏情况下的商业条件，V
CC
= 3.0V ，T
J
= 70°C)
' -3 '速度
'-2 '速度
“-1”速度
“标准”速度
“ -F ”速度
参数说明
输入模块预测布线延迟
1
t
IRD1
t
IRD2
t
IRD3
t
IRD4
t
IRD8
FO = 1路由延迟
FO = 2路由延迟
FO = 3路由延迟
FO = 4路由延迟
FO = 8路由延迟
分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。单位
2.9
3.6
4.4
5.1
8.0
3.4
4.2
5.0
5.9
9.26
3.8
4.8
5.7
6.7
10.5
4.5
5.6
6.7
7.8
12.6
6.3
7.8
9.4
11.0
17.3
ns
ns
ns
ns
ns
全局时钟网络
t
长实
t
CKL
t
威尔斯亲王医院
t
PWL
t
CKSW
t
P
f
最大
输入从低到高
输入前高后低
最小脉冲
宽高
最小脉冲
宽度低
最大倾斜
最小周期
FO = 16
FO = 128
FO = 16
FO = 128
FO = 16
FO = 128
FO = 16
FO = 128
FO = 16
FO = 128
FO = 16
FO = 128
6.5
6.8
113
109
3.1
3.3
3.1
3.3
0.6
0.8
7.5
7.8
105
101
6.4
6.4
6.7
6.7
3.6
3.8
3.6
3.8
0.6
0.9
8.5
8.9
96
92
7.4
7.4
7.8
7.8
4.1
4.3
4.1
4.3
0.7
1.0
10.1
10.4
83
80
8.3
8.3
8.8
8.8
4.8
5.1
4.8
5.1
0.8
1.2
14.1
14.6
50
48
9.8
9.8
10.4
10.4
6.7
7.1
6.7
7.1
1.2
1.6
13.7
13.7
14.5
14.5
ns
ns
ns
ns
ns
ns
兆赫
最大频率fo = 16
FO = 128
TTL输出模块时序
4
t
DLH
t
DHL
t
ENZH
t
ENZL
t
ENHZ
t
ENLZ
d
TLH
d
THL
注意事项：
1.路由延迟对于典型设计跨最坏情况下的运行工况。这些参数应该被用于估计
器件的性能。布线后的时序分析或模拟需要确定实际性能。
2.设置时间假设3.进一步测试扇出的信息可以从定时程序来获得。
3.保持时间为DFME1A宏可以大于0毫微秒。从Designer软件使用定时器工具来检查货舱
时间这个宏。
4.延误基于35 pF的负载。
数据 - 垫高
数据对垫低
启用垫Z到高
启用垫Z到低
启用垫高到Z
启用垫低到Z
三角洲低到高
台达高到低
4.7
5.6
5.2
6.6
11.1
8.2
0.03
0.04
5.4
6.4
6.0
7.6
12.8
9.5
0.03
0.04
6.1
7.3
6.8
8.6
14.5
10.7
0.04
0.05
7.2
8.6
8.1
10.1
17.1
12.6
0.04
0.06
10.0
12.0
11.3
14.1
23.9
17.7
0.06
0.08
ns
ns
ns
ns
ns
ns
NS / PF
NS / PF
1 -4 0
v6.0
