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军队的ProASIC3 / EL低功耗快闪FPGA
的I / O时序特性总结 - 默认的I / O软件设置
表2-27
交流记忆点总结
*
标准
3.3 V LVTTL / 3.3 V LVCMOS
2.5 V LVCMOS
1.8 V LVCMOS
1.5 V LVCMOS
1.2 V LVCMOS *
3.3 V PCI
3.3 V PCI -X
3.3 V GTL
2.5 V GTL
3.3 V GTL +
2.5 V GTL +
HSTL （I）的
HSTL （II）的
SSTL2 （I）的
SSTL2 （II）的
SSTL3 （I）的
SSTL3 （II）的
LVDS
LVPECL
输入参考电压
(V
REF_TYP
)
–
–
–
–
–
–
–
0.8 V
0.8 V
1.0 V
1.0 V
0.75 V
0.75 V
1.25 V
1.25 V
1.5 V
1.5 V
–
–
董事会终止
电压（V
TT_REF
)
–
–
–
–
–
–
–
1.2 V
1.2 V
1.5 V
1.5 V
0.75 V
0.75 V
1.25 V
1.25 V
1.485 V
1.485 V
–
–
测量跳变点
(V
旅
)
1.4 V
1.2 V
0.90 V
0.75 V
0.6V
0.285 * V
CCI
(RR)
0.615 * V
的CCI （FF） ）
0.285 * V
的CCI （ RR）的
0.615 * V
的CCI （FF）
V
REF
V
REF
V
REF
V
REF
V
REF
V
REF
V
REF
V
REF
V
REF
V
REF
交叉点
交叉点
*
适用于A3PE600L和A3PE3000L的设备仅为1.2 V核心区运行。
表2-28
I / O AC参数定义
参数
t
DP
t
PY
t
DOUT
t
EOUT
t
DIN
t
HZ
t
ZH
t
LZ
t
ZL
t
ZHS
t
ZLS
参数定义
通过输出缓冲器的数据延迟垫
垫到数据延迟通过输入缓冲器
通过I / O接口数据输出缓冲器延迟
通过I / O接口使能到输出三态缓冲器的延迟控制
输入缓冲器的延迟数据通过I / O接口
通过输出缓冲器，高到Z启用以垫延迟
启用以垫延迟通过输出缓冲器-Z到高
通过输出缓冲器，低到Z启用以垫延迟
启用以垫延迟通过输出缓冲器- Z到低
通过输出缓冲器能以垫延迟，延迟启用-Z到高
通过输出缓冲器能以垫延迟，延迟启用- Z到低
v1.0
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