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CY8C20234 ， CY8C20334
CY8C20434 ， CY8C20534
表27. 2.7V （标称值）交流外部时钟规范
符号
F
OSCEXT
描述
与CPU时钟进行频率1
民
0.750
典型值
–
最大
3.08
0
单位
兆赫
笔记
最大CPU频率为3 MHz的频率，
2.7V 。随着CPU时钟分频器设置
1 ，外部时钟必须坚持
的最大频率和占空比
周期的要求。
如果外部时钟的频率
大于3兆赫，CPU时钟
除器被设为2或更大。在这
情况下，CPU时钟分频器确保可靠
该50 ％的占空比
要求得到满足。
F
OSCEXT
与CPU时钟分频2或
更大
0.15
–
6.35
兆赫
–
–
–
高周期与CPU时钟进行1
低周期与CPU时钟进行1
上电国际海事组织开关
160
160
150
–
–
–
5300
–
–
ns
ns
μs
表28. 2.7V （最低）交流外部时钟规范
符号
F
OSCEXT
描述
与CPU时钟进行频率1
民
0.750
典型值
–
最大
6.3
0
单位
兆赫
笔记
最大CPU频率为6 MHz的时
2.7V 。随着CPU时钟分频器设置
1 ，外部时钟必须坚持
的最大频率和占空比
周期的要求。
如果外部时钟的频率
大于6兆赫，CPU时钟
除器被设为2或更大。在这
情况下，CPU时钟分频器确保可靠
该50 ％的占空比
要求得到满足。
F
OSCEXT
与CPU时钟分频2或
更大
0.15
–
12.6
兆赫
–
–
–
高周期与CPU时钟进行1
低周期与CPU时钟进行1
上电国际海事组织开关
160
160
150
–
–
–
5300
–
–
ns
ns
μs
交流编程规范
表29
列出了许可的最大和最小规格的电压和温度范围内以5.25V和-40°C 4.75V
≤
T
A
≤
85°C ， 3.0V至3.6V和-40°C
≤
T
A
≤
85°C ，或2.4V至3.0V以及-40°C
≤
T
A
≤
85 ℃。典型参数适用
5V ， 3.3V或2.7V， 25°C时。这些仅作为设计指导。
表29.交流编程规范
符号
T
RSCLK
T
f运行
T
SSCLK
T
HSCLK
F
SCLK
T
ERASEB
T
写
T
DSCLK
T
DSCLK3
T
DSCLK2
描述
SCLK的上升时间
秋季SCLK的时间
数据建立时间SCLK的下降沿
数据保持时间从SCLK的下降沿
SCLK的频率
闪存擦除时间（块）
闪存块写入时间
数据输出延迟从SCLK的下降沿
数据输出延迟从SCLK的下降沿
数据输出延迟从SCLK的下降沿
民
1
1
40
40
0
–
–
–
–
–
典型值
–
–
–
–
–
15
30
–
–
–
最大
20
20
–
–
8
–
–
45
50
70
单位
ns
ns
ns
ns
兆赫
ms
ms
ns
ns
ns
3.6
＆ LT ;
VDD
3.0
≤
VDD
≤
3.6
2.4
≤
VDD
≤
3.0
笔记
文件编号： 001-05356修订版* H
第23页34
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