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JTAG
表42. JTAG AC时序规范（ SYS_CLK_IN独立）
1
（续）
在推荐工作条件（见
表2）。
参数
输出保持时间：
边界扫描数据
TDO
JTAG外部时钟输出高阻抗：
边界扫描数据
TDO
符号
2
民
最大
单位
笔记
t
JTKLDX
t
JTKLOX
t
JTKLDZ
t
JTKLOZ
2
2
2
2
—
—
19
9
ns
5
ns
5, 6
注意事项：
1.所有的输出都从吨的下降/上升边的中点电压测量
TCLK
所讨论的信号的中点。
的输出定时在销测定。所有的输出时序假设一个纯电阻50 Ω负载（参见
图40） 。
飞行时间的延误，必须对走线，通孔，并在系统中的连接器被添加。
2.用于定时规范的符号跟着T的模式
（功能块的头两个字母）（信号）（状态）（参照）（状态）的
为
输入和T
（功能块的头两个字母）（参考）（状态）（信号）（状态）的
用于输出。例如，叔
JTDVKH
象征JTAG器件
定时（ JT）相对于时间的数据输入信号（D）中达到有效的状态（V ）相对于所述吨
JTG
时钟基准（ K）
将H（高）状态或设置时间。此外，T
JTDXKH
象征JTAG时序（ JT）相对于所述时间数据的输入信号
（ D）去无效的（ X）相对于T
JTG
时钟基准（ K），将H（高）状态。需要注意的是，在一般情况下，该时钟参考
符号表示法是基于三个字母代表的特定的功能的时钟。对于上升和下降时间，该
后者约定使用相应的字母： R（上升）或F （下降） 。
3. TRST是一个异步电平触发信号。建立时间仅用于测试目的。
4.非JTAG对于输入信号时序吨
TCLK
.
5.非JTAG对于信号输出时序吨
TCLK
.
6.通过设计和特性保证。
图40
提供交流测试负载为TDO和边界扫描输出。
产量
Z
0
= 50
Ω
R
L
= 50
Ω
NV
DD
/2
图40. AC测试负载的JTAG接口
图41
提供JTAG时钟输入时序图。
JTAG
外部时钟
VM
t
JTKHKL
t
JTG
VM =中点电压（ NV
DD
/2)
VM
VM
t
JTGR
t
JTGF
图41. JTAG时钟输入时序图
MPC8308的PowerQUICC II Pro处理器硬件规格，第0版
54
飞思卡尔半导体公司
