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TMS320C6713B
浮点数字信号处理器
SPRS294B - 2005年10月 - 修订2006年6月
设备特点
表2提供了C6713B DSP的概述。表中示出了装置的显著功能，包括
片上RAM ，外设，执行时间的能力，并与引脚数封装类型。欲了解更多
在C67x DSP器件部件号和零件编号的详细信息，请参阅图12 。
表2中。 C6713B处理器的特征
硬件特性
外设
EMIF
EDMA
（ 16个通道）
HPI （16位）
McASPs
I2Cs
McBSP的
外围表现
依赖于芯片级
配置。
32位定时器
GPIO模块
大小（字节）
片上存储器
内部时钟
来源
SYSCLK3或ECLKIN
CPU时钟频率
SYSCLK2
AUXCLK ， SYSCLK2
SYSCLK2
SYSCLK2
SYSCLK2 1/2
SYSCLK2
C6713B
（浮点DSP ）
GDP /知柏地黄丸
1（32位）的
1
1
2
2
2
2
1
264K
4K字节（ 4KB ） L1程序（ L1P ）高速缓存
4KB L1数据（ L1D ）缓存
统一64KB二级缓存/内存映射
192KB L2内存映射
0x0203
300, 225, 200
3.3纳秒（GDP - 300 ， ZDP -300 ）
4.4纳秒（GDP - 225 ， ZDP -225 ）
5纳秒（ GDPA -200
ZDPA-200)
1.20 V
1.4 V (300)
3.3 V
/1, /2, /3, ..., /32
x4, x5, x6, ..., x25
/1, /2, /3, ..., /32
272球BGA （ GDP）
272球BGA （ ZDP ）
0.13
208引脚PowerPAD
PQFP （ PYP ）
225, 200, 167
5纳秒（ PYP -200 ）
4.4纳秒（ PYP -225 ）
6纳秒（ PYPA - 167 ）
5纳秒（ PYPA -200 ）
1.2 V
PYP
1（16位）的
不是所有的外设引脚
可在同一
时间。 （有关详细信息，
看到设备
配置部分。 ）
组织
CPU ID + CPU版本号
BSDL文件
频率
控制状态寄存器（CSR 。 [31:16] ）
对于C6713B BSDL文件，请联系您的现场销售代表。
兆赫
周期
ns
电压
核心（ V）
I / O （ V）
时钟发生器选件
预分频器
倍增器
分频器
27× 27毫米
套餐
28× 28毫米
工艺技术
m
产品状态
产品预览（ PP）
PD
高级信息（ AI）
生产数据（ PD ）
AUXCLK是的McASP内部高频时钟源用于串行传输。 SYSCLK2是用于时钟的McASP系统时钟
检查（高频）电路。
该值与现有的1.26 -V的外观设计相兼容。
PRODUCTION数据信息为出版日期。产品符合每德州仪器条款规范
标准保修。生产加工并不包括所有参数进行测试。
的C67x是德州仪器的商标。
12
邮政信箱1443
休斯敦，得克萨斯州77251-1443
