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CY8C20X36/46/66/96
逻辑框图
端口4
端口3
端口2
端口1
端口0
1.8/2.5/3V
LDO
PWRSYS
（稳压）
PSoC核心
系统总线
全球模拟互连
1K/2K
SRAM
打断
调节器
监事会ROM （ SROM ）
8K / 16K / 32K闪存
非易失性存储器
睡眠和
看门狗
CPU内核（ M8C ）
6/12/24 MHz内部主振荡器
（ IMO）
内部低速振荡器（ ILO ）
多个时钟源
的CapSense
系统
两
比较
的CapSense
模块
类似物
参考
类似物
MUX
系统总线
USB
I2C
SLAVE
国内
电压
参考文献：
系统
复位
POR
和
LVD
SPI
主/
SLAVE
3个16位
可编程
计时器
数字
钟
系统资源
文件编号： 001-12696修订版* E
第39 2
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