位置：首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1438页 > ADP3193AJCPZ-RL > ADP3193AJCPZ-RL PDF资料 > ADP3193AJCPZ-RL PDF资料2第13页
ADP3193A
OUTPUT ENABLE和UVLO
对于ADP3193A开始切换，输入电压（ VCC ）
控制器必须大于UVLO阈值更高，
EN引脚必须比其0.85 V阈值较高。这
启动系统的启动序列。如果任UVLO或EN为
小于其相应的阈值时， ADP3193A被禁用。
这个拥有PWM输出接地，短路的延迟
电容接地，并迫使PWRGD和OD的信号低。
表4. VR11和同时针对VR10.x VID代码为ADP3193A
产量
关闭
关闭
1.60000
1.59375
1.58750
1.58125
1.57500
1.56875
1.56250
1.55625
1.55000
1.54375
1.53750
1.53125
1.52500
1.51875
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1.50625
1.50000
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1.48125
1.47500
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1.41875
1.41250
1.40625
1.40000
1.39375
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1.38125
1.37500
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1.36250
1.35625
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1.33750
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VID7
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VR11 DAC码： VIDSEL = HIGH
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VID4
同时针对VR10.x DAC码： VIDSEL = LOW
VID3 VID2 VID1 VID0 VID5
不适用
不适用
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VID6
在应用电路中（参见图10 ）时， OD端子应
连接到ADP3120A司机的OD的输入。接地
外径禁用驱动使得两个DRVH和DRVL是
接地。这个特点是在防止放电重要
的输出电容时，所述控制器被关断。如果
驱动器输出不会被禁用时，可以产生一个负电压
输出过程中，由于在输出的高电流放电
通过电感器的电容器。
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修订版1 |第13页第29 | www.onsemi.com
