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40MX和42MX汽车FPGA系列
表1-10
A40MX04时序特性（标称5.0V操作）
最坏情况下的汽车条件，V
CC
= 4.75V ，T
J
= 125°C
标准。速度
参数
全局时钟网络
t
长实
输入从低到高
FO = 16
FO = 128
t
CKL
输入前高后低
FO = 16
FO = 128
t
威尔斯亲王医院
最小脉冲宽度高
FO = 16
FO = 128
t
PWL
最小脉冲宽度低
FO = 16
FO = 128
t
CKSW
最大倾斜
FO = 16
FO = 128
t
P
最小周期
FO = 16
FO = 128
f
最大
最大频率
FO = 16
FO = 128
TTL输出模块时序
4
t
DLH
t
DHL
t
ENZH
t
ENZL
t
ENHZ
t
ENLZ
d
TLH
d
THL
注意事项：
1.路由延迟对于典型设计跨最坏情况下的运行工况。这些参数应该被用于估计
器件的性能。布线后的时序分析或模拟需要确定实际性能。
2.安装时间假设3.进一步测试信息的扇出可以从定时器工具来获得。
3.保持时间为DFME1A宏可以大于0毫微秒。使用定时器工具Designer检查保持时间为这个
宏。
4.延误基于35 pF的负载。
数据 - 垫高
数据对垫低
启用垫Z到高
启用垫Z到低
启用垫高到Z
启用垫低到Z
三角洲低到高
台达高到低
5.9
7.1
6.7
8.3
14.1
10.4
0.03
0.05
ns
ns
ns
ns
ns
ns
NS / PF
NS / PF
8.3
8.7
120
116
3.9
4.2
3.9
4.2
0.7
0.9
8.2
8.2
8.7
8.7
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
兆赫
兆赫
描述
分钟。
马克斯。
单位
v3.1
1-31
