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56F803概述
高达40 MIPS在80MHz的核心频率
DSP和MCU功能集成于一个统一的，
C-高效的架构
硬件DO和REP循环
MCU友好的指令集同时支持DSP和
控制器功能： MAC ，位操作单元， 14
寻址模式
31.5K
×
16位字（ 64KB ）程序闪存
512
×
16位字（ 1KB ）程序RAM
4K
×
16位字（ 8KB ）的数据闪存
2K
×
16位字（4KB）数据RAM
2K
×
16位字（ 4KB ）引导闪存
高达64K
×
每一个外部程序的16位字
和数据存储器
6通道PWM模块
两个4通道12位ADC
正交解码器
CAN 2.0 B模块
串行通信接口（ SCI ）
串行外设接口（SPI ）
最多两个通用定时器四
JTAG /次
TM
端口进行调试
16共享GPIO线
100引脚LQFP封装
6
3
3
PWM输出
电流检测输入
故障输入
PWMA
RESET
IRQA
EXTBOOT
IRQB
6
JTAG /
一旦
PORT
VCAPC V
DD
2
6
V
SS
6*
数字注册
模拟注册
V
DDA
V
SSA
4
4
A/D1
A/D2
VREF
ADC
打断
调节器
低电压
监
4
QUADRATURE
解码器0 /
四定时器A
程序控制器
和
硬件循环机组
地址
GENERATION
单位
数据ALU
16 x 16 + 36
→
36位MAC
3个16位输入寄存器
两个36位累加器
位
操作
单位
程序存储器
32252 ×16闪光
512 ×16的SRAM
四定时器B
四定时器C
四定时器D
2
CAN 2.0A / B
2
2
SCI
or
GPIO
COP /
看门狗
数据存储器
4096 ×16闪光
2048 ×16的SRAM
引导闪存
2048× 16闪光
PAB
PDB
IPBB
控制
16
PLL
CLKO
XDB2
CGDB
XAB1
XAB2
16-Bit
56800
CORE
XTAL
CLOCK GEN
EXTAL
打断
控制
16
COP复位
模块控制
地址总线[ 8：0]
数据总线〔 15：0]
4
SPI
or
GPIO
应用
化专用
内存&
外设
IPBus桥
（ IPBB ）
外
公共汽车
接口
单位
外
地址总线
开关
外
数据总线
开关
公共汽车
控制
A[00:05]
6
10
16
PS选择
DS选择
WR启用
RD启用
A [ 06:15 ]或
GPIO - E2 ： E3 &
GPIO - A0 ： A7
D[00:15]
56F803框图
*
包括TCS引脚是保留给工厂使用，并连接到VSS
56F803技术数据，版本16
飞思卡尔半导体公司
3
