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CY7C601xx ， CY7C602xx
6.1引脚分配
表6-1 。引脚分配
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
7
6
42
43
34
35
36
37
38
39
40
41
15
14
13
12
11
10
9
8
25
3
2
38
39
30
31
32
33
34
35
36
37
11
10
9
8
7
6
5
4
21
5
4
3
2
15
14
13
20
24
25
26
27
11
10
11
10
18
17
19
20
18
19
1
2
24
PDIP
名字
P4.0
P4.1
P4.2
P4.3
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
P2.0
P2.1
P2.2
P2.3
P2.4
P2.5
P2.6
P2.7
P1.0
GPIO口位0
如果此引脚用作通用输出它汲取电流。
据，因此，被配置为输入，以减少电流消耗。
GPIO口位1
如果此引脚用作通用输出它汲取电流。
据，因此，被配置为输入，以减少电流消耗。
GPIO口位2
GPIO口位分别3配置
复用功能是SPI总线的SSEL信号。
GPIO端口1位独立4配置
复用功能是SPI总线的SCLK信号。
GPIO口位分别5配置
复用功能是SPI总线的SMOSI信号。
GPIO端口1位独立6配置
复用功能是SPI总线的SMISO信号。
GPIO端口1位独立7配置
TTL电压阈值。
GPIO端口0位0分别配置
在CY7C601xx ，可选的时钟输入，当外部振荡器
当外部振荡器被禁止或外部振荡器输入
启用。
在CY7C602xx ，振荡器输入当配置为时钟输入。
GPIO端口2配置为一组（字节）
GPIO端口3设置为一组（字节）
描述
GPIO端口4配置为一组（半字节）
26
22
16
15
14
21
P1.1
28
29
30
31
32
33
24
25
26
27
28
29
18
19
20
21
22
23
17
18
21
22
23
24
16
17
20
21
22
23
23
24
3
4
5
6
P1.2
P1.3/SSEL
P1.4/SCLK
P1.5/SMOSI
P1.6/SMISO
P1.7
23
19
13
9
9
16
P0.0/CLKIN
文件38-16016牧师* F
第68 4
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