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ADS6149/ADS6129
ADS6148/ADS6128
SLWS211B - 2008年7月 - 修订2008年10月
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典型特征 - ADS6129 （续）
所有地块都在25 ° C， AVDD = 3.3 V ， DRVDD = 1.8 V ，最大额定采样频率，正弦波输入时钟。 1.5 V
PP
差分时钟的幅度， 50 ％时钟占空比， -1 dB的差分模拟输入，内部基准模式，0 dB增益，
LVDS输出接口（除非另有说明）
SFDR
vs
输入频率
100
95
90
SFDR - dBc的
85
80
75
70
65
60
55
50
0
50
100 150 200 250 300 350 400 450 500
f
IN
- 输入频率 - MHz的
G045
SNR
vs
输入频率
74
73
LVDS
SNR - dBFS的
72
71
70
69
68
67
66
65
64
0
50
100 150 200 250 300 350 400 450 500
f
IN
- 输入频率 - MHz的
G046
CMOS
LVDS
CMOS
图57 。
SFDR
vs
收益
100
95
90
SFDR - dBc的
85
80
75
70
65
60
55
50
0
50
100 150 200 250 300 350 400 450 500
f
IN
- 输入频率 - MHz的
G047
图58 。
SINAD
vs
收益
75
73
71
SINAD - dBFS的
69
67
65
63
61
1分贝
0分贝
59
57
55
0
50
100 150 200 250 300 350 400 450 500
f
IN
- 输入频率 - MHz的
G048
输入调整以获得-1dBFS输入
3分贝
4分贝
5分贝
6分贝
0分贝
1分贝
2分贝
3分贝
4分贝
5分贝
6分贝
输入调整以获得-1dBFS输入
2分贝
图59 。
图60 。
38
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2008 ，德州仪器
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