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1.4.11
ST
该引脚执行双重功能。当驱动为逻辑高电平时，内部自测试电压发生器被激活。一个低到
在此引脚为高电平跳变将清除内部状态锁存。请注意，在某些故障条件下，该状态闩会
立即复位，表示终端故障状态。
在锁定状态下的设备初始化一个图示操作说明
图1-5 。
ST
自检启用
V
DD
D
Q
R
状态
故障检测
图1-5 ST和互动状态
1.4.12
CAP / HOLD
当这个输入引脚为低电平时，加速度数据由每当一个数据样本变为可用的DSP更新。在一个低到
CAP / HOLD加速度数据的高转换被冻结。作为引脚保持在逻辑加速度数据不更新，只要
'1'电平。该引脚可直接连接到V
SS
如果该保持功能是不希望的。
1.4.13
X
OUT
, Y
OUT
两个数字 - 模拟转换器（DAC ）被提供。这些转换器转换的DSP模块的输出转换成电压等级亲
portional到的数值结果的大小和比例，以V
CC
.
1.5
外部元件
所示的连接
图1-1
被推荐的。细心的印刷电路板布局和元件布局是上课 -
sential以获得最佳性能。低ESR电容必须连接到C
REG
和C
REGA
引脚以获得最佳性能。一
用阻焊层接地面积应当放置在包装下为设备的从外部改善屏蔽
的影响。如果没有提供一个陆地面积，没有信号应该被路由封装的下面。看
图1-1 。
MMA6222AEG
6
传感器
飞思卡尔半导体公司
