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XC161CS-32F
衍生产品
电气参数
4.4.2
片内Flash操作
该XC161的Flash模块固定接入的时间内提供的数据（见
表17
).
访问到Flash模块是由PMI控制，并采取1 + WS时钟周期，
其中，通过位域WSFLASH中选择WS的Flash访问的等待状态数
注册IMBCTRL 。接入相的生成的持续时间必须覆盖访问
时间
t
加
闪存阵列中。因此，所需要的闪光等待状态取决于
可用速度等级，以及对实际系统的频率。
注： Flash访问的等待状态只影响非顺序访问。由于
预取机制，对于顺序访问性能（根据
的软件结构）仅部分地由等待状态的影响。
在典型应用中，消除一种等待状态增加了平均
5％ ... 15 ％的性能。
表17
参数
闪存特性
（适用的工作条件）
符号
分钟。
限值
典型值。
马克斯。
单位
闪存模块访问时间（标准）
闪存模块访问时间（ A级）
每128字节的块编程时间
删除每个扇区的时间
t
加
t
加
t
PR
t
ER
CC
CC
CC
CC
–
–
–
–
–
–
2
2)
200
2)
70
1)
50
1)
5
500
ns
ns
ms
ms
1 ）实际存取时间也由系统频率的影响，所以频率范围不是完全线性的。
SEE
表18
.
2）执行编程和擦除时间取决于系统的频率。典型的值是有效的为40兆赫。
例如：对于40 MHz的工作频率（时钟周期= 25纳秒） ，标准设备
必须用2等待状态下工作： （ （2 + 1）的
×
25纳秒）
≥
70纳秒。
A级设备可以与1等待状态下工作： （ （ 1 + 1 ）
×
25纳秒）
≥
50纳秒。
表18
表示等待状态，系统频率和速度等级的相互关系。
表18
Flash访问的等待状态
频率范围
标准的高速闪存
频率范围
闪存高速A级
所需的等待状态
0 WS （ WSFLASH = 00
B
)
1 WS （ WSFLASH = 01
B
)
2 WS （ WSFLASH = 10
B
)
f
中央处理器
≤
16兆赫
f
中央处理器
≤
28兆赫
f
中央处理器
≤
40 MHZ
f
中央处理器
≤
20兆赫
f
中央处理器
≤
40 MHZ
f
中央处理器
≤
40 MHZ
注意：可达到的最大系统频率是由所述的性质的限制
各衍生工具，即40兆赫（或20MHz为XXX- 32F20F设备） 。
数据表
69
V1.2, 2006-08
