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恩智浦半导体
ADC1213D系列
ADC1213D系列
包
ESD
寄生
共模
参考
1.5 V
VCMA
VCMB
0.1
μF
ADC内核
005aaa077
图15.参考等效电路图
14.2.4偏置
所述共模输出电压V
O（ CM ）
，应在外部设置为1.5V（典型值） 。该
共模输入电压V
I（ cm）的
在输入到采样和保持电路
（引脚INAM ， INBM ， INAP和INBP ）必须是最优的0.9 V和2 V
性能。
14.3时钟输入
14.3.1驱动模式
该ADC1213D可驱动差分（ SINE ， LVPECL或LVDS）具有很少或没有
影响动态性能。它也可以由一个单端LVCMOS驱动
信号连接到针CLKP （CLKM应连接经由一个电容器接地） 。
LVCMOS
时钟输入
CLKP
CLKP
CLKM
LVCMOS
时钟输入
CLKM
005aaa174
005aaa053
一。上升沿LVCMOS
图16. LVCMOS单端时钟输入
B 。下降沿LVCMOS
ADC1213D_SER_5
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初步数据表
版本05 - 2010年4月23日
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