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XCR3032XL 32宏单元CPLD
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DS023 （ V2.2 ） 2008年9月15日
产品speci fi cation
特点
低功率3.3V 32宏单元CPLD
4.5 ns的引脚对引脚的逻辑延迟
系统频率高达213 MHz的
32宏单元750可用门
可在小型封装
- 48球BGA CS （ 36个用户I / O引脚）
- 44引脚VQFP （ 36用户I / O ）
优化3.3V系统
- 超低功耗运行
- 17的典型待机电流
μA
在25℃下
- 5V容限I / O引脚3.3V内核电源
- 先进的0.35微米五层金属EEPROM
过程
- 快速零功率（ FZP ） CMOS技术
- 3.3V PCI电气规格兼容
对任何输入输出（无内部钳位二极管或
I / O，没有最低时钟输入电容）
先进的系统功能
- 在系统编程
- 输入寄存器
- 可预测的时序模型
- 最多每个功能块23可用的时钟
- 在设计变更优秀销固定
- 完整的IEEE标准1149.1边界扫描（ JTAG ）
- 四个全局时钟
- 每个功能块八乘积项控制项
快速ISP编程时间
端口使能引脚的JTAG ISP引脚的双重功能
2.7V至在工业温度3.6V电源电压
范围
每个宏单元可编程转换速率控制
安全位可以防止未经授权的访问
请参阅的CoolRunner XPLA3系列数据表
（ DS012 ）的体系结构描述
描述
了CoolRunner XPLA3 XCR3032XL设备是3.3V ，
32宏单元CPLD针对功率敏感的设计
这需要领先的可编程逻辑解决方案。一
共有两个功能块提供750可用门。
引脚至引脚的传播延迟是一样快4.5 ns时
213 MHz的最大系统频率。
TotalCMOS设计技术快速
零功率
的CoolRunner XPLA3 CPLD提供一个TotalCMOS的解决方案，
无论是在工艺技术和设计技术。赛灵思
CPLD器件采用CMOS门电路的级联来实现其
的产品，而不是传统意义上的放大器总和
的方法。此CMOS门电路实现允许赛灵思
提供CPLD器件是高性能和低功耗，
破了具有低功耗的模式，就必须
具有低的性能。请参阅
图1
和
表1
展示 -
荷兰国际集团的我
CC
主场迎战XCR3032XL TotalCMOS频率
采取具有两个可复位的上/下， 16位的CPLD （数据
柜台在3.3V ， 25 ° C） 。
20
典型的我
CC
（MA ）
15
10
5
0
0
20
40
60
80
100
120
140
160
180
200
频率（MHz）
DS023_01_080101
图1：
I
CC
在主场迎战V频率
CC
= 3.3V ，25°C
表1：
I
CC
与频率的关系
(V
CC
= 3.3V ， 25 ° C）
频率（MHz）
典型的我
CC
（MA ）
0
0.017
1
0.13
5
0.54
10
1.06
20
2.09
50
5.2
100
10.26
200
20.3
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http://www.xilinx.com/legal.htm 。
所有其他商标和注册商标均为其各自所有者的财产。所有规格如有变更，恕不另行通知。
DS023 （ V2.2 ） 2008年9月15日
产品speci fi cation
www.xilinx.com
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