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SL23EP09
概述
该SL23EP09是一个低偏移，低抖动的零延迟缓冲器
具有非常低的工作电流。
该产品包括一个片上高性能PLL，它
锁定到输入的参考时钟，并产生九（9）
输出的时钟驱动器跟踪输入参考时钟
系统要求时钟分配。
除了CLKOUT的是，用于为内部PLL
反馈，有两个（2）银行具有四个（4）输出
每个存储体，使总的可用输出数
钟到九（9） 。
输入和输出频率范围
输入和输出频率范围是相同的。但是，它
依赖于如在下面给出的VDD和驱动电平
表1中。
选择输入控制
该SL23EP09提供两（2 ）输入选择控制引脚
称为S1和S2 。该功能使用户能够选择
输出时钟银行A和银行B，输出的各种状态
源和如表2所示的PLL的关断特性。
在S1 （引脚9 ）和S2 （引脚8 ）输入包括250
上拉电阻连接到VDD。
PLL旁路模式
如果S2和S1引脚的逻辑高（1）和低（0）
分别在片上PLL关闭和旁路，
和所有的九个输出时钟A银行， B银行和CLKOUT
时钟都直接从参考输入时钟驱动。在
这种操作模式SL23EP09像一个非ZDB扇出
缓冲区。
高和低驱动器产品选项
该SL23EP09提供高驱动器“ -1H”和
标准驱动器“-1”的选项。这些驱动器选项启用
用户控制的负载水平，频率范围和EMI
控制权。请参阅用于详细的交流电表。
歪斜和零延迟
所有输出应该推动类似的负载，以实现输出用于─
定在输出偏移和输入 - 输出规格
AC电气表。然而，零输入之间的延迟
和输出可以通过改变的量，来调节
CLKOUT相对于因为银行A和B的时钟
CLKOUT是反馈到PLL 。
电源电压范围（ VDD ）
该SL23EP09被设计在一个很宽的功率来操作
电源电压范围从2.3V （最小值）至3.6V （最大） 。内部导通
片上稳压器用于提供PLL恒功率
供给1.8V ，导致一个一致和稳定的PLL
中的歪斜，抖动和功率方面的电气性能
耗散。联系SLI的1.8V电源版本ZDB
所谓SL23EPL09 。
弱
Vdd的（V）的
3.3
3.3
2.5
2.5
DRIVE
高
性病
高
性病
敏（兆赫）
10
10
10
10
马克斯（兆赫）
220
167
200
133
表1.输入/输出频率范围
如果在输入时钟频率是直流电压（ GND至VDD）时，这是
由一个输入频率检测电路和所有检测到的
9个时钟输出被强制为Hi -Z 。该PLL是
关机，以节省电力。在这种关机状态下，该产品
功耗低于12电源电流。
SpreadThru
特征
如果一个扩频时钟（SSC）被用作一个
输入时钟，则SL23EP09被设计成通过
从调制扩频时钟（ SSC ）信号，其
参考输入到输出时钟。相同的扩展
在输入特性是通过锁相环传递和
没有任何退化的驱动程序在传播百分比（％ ）
传播形象和调制频率
1.1版， 2007年2月2日
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