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PIC12C5XX
7.0.2
串行时钟
7.1.4
数据有效（D ）
这SCL输入用于同步的数据传输
从和到设备。
数据线的状态代表有效数据时，
后一个启动条件，数据线是稳定的
持续时间的时钟信号的高电平期间。
线上的数据必须在LOW改变
周期的时钟信号的。有每一个数据位
时钟脉冲。
每次数据传输开始于一个启动条件
并终止了与停止条件。数
START和之间传送的数据的字节
停止条件由主器件决定
而在理论上是无限的。
7.1.5
应答
7.1
总线特性
以下
总线协议
是要与使用
EEPROM数据存储器。
数据传输，可以只启动，当公交车
不忙。
在数据传输过程中，数据线必须保持稳定
每当时钟线为高电平。数据变化的
线，而时钟线高电平将被解释为一
启动或停止条件。
因此，以下总线条件已
定义（图7-3 ） 。
7.1.1
总线不忙（ A）
每个接收设备，被寻址的责任
生成各接收一个应答信号
字节。主器件必须产生一个额外的时钟
一个与此应答位相关的脉冲。
注意：
如果不产生应答位
内部编程周期正在进行中。
数据和时钟线保持高电平。
7.1.2
启动数据传输（ B）
前高后SDA线同时从高到低的跳变
时钟（ SCL ）为高电平产生启动条件。所有
命令前面必须有一个起始条件。
7.1.3
停止数据传输（ C）
从低到SDA线，而高的转换
时钟（ SCL ）为高电平产生停止条件。所有
操作必须以一个停止条件。
应答器件必须拉低
在应答时钟脉冲在这样的SDA线
方式， SDA线是在高稳定低
期间应答相关的时钟脉冲。的
当然，建立和保持时间必须要考虑的
帐户。主器件必须信号数据的的结束
从站通过不产生应答位上的最后一个
字节已同步输出的奴隶。在这种情况下，
从机必须保持数据线为高电平，使
主机产生停止条件（图7-4 ） 。
1999 Microchip的技术公司
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