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图11-3 。
同步读取引脚电时的值
系统CLK
说明
SYNC LATCH
PINxn
r17
0x00
t
PD ，最大
t
PD ，分
0xFF
XXX
XXX
在R17 ，品克斯
考虑系统时钟的第一个下降沿之后起始的时钟周期。闩锁
被关闭时，时钟为低电平，并进入透明当时钟为高电平时，由所指示的
在“SYNC LATCH ”信号的阴影区。所述信号值被锁存时，系统时钟
变低。它移入PINxn寄存器的，在随后的时钟上升沿。由于indi-
由两个箭头吨cated
PD ，最大
和T
PD ，分
，引脚上的信号转换将推迟
between ½ and 1½ system clock period depending upon the time of assertion.
当读回一个指定的软件引脚值， NOP指令必须被插入的indi-
符在
图11-4 。
OUT指令设置在正面边缘“SYNC LATCH ”信号
时钟。在这种情况下，延迟吨
pd
通过同步器是1个系统时钟周期。
图11-4 。
同步读取软件分配的PIN值时，
系统CLK
r16
说明
SYNC LATCH
PINxn
r17
0x00
t
pd
0xFF
出的PORTx ， R16
NOP
0xFF
在R17 ，品克斯
下面的代码示例演示了如何置位端口B的引脚0和1， 2和3 ，以及将
端口引脚4至7个作为输入与分配给端口的引脚6和7所得到的针上拉
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AT90PWM2/3/2B/3B
4317J–AVR–08/10
