飞思卡尔半导体公司
DSP56364概述
特点
- 数据ALU为24 ×24位乘法累加器和一个56位的桶形移位器。 16位
算法的支持。
- 与位置无关的代码，支持和指令缓存程序控制
支持。
- 六通道DMA控制器。
- 基于PLL的时钟具有宽范围的频率的乘法（1至4096 ） ，
预分频器因子（ 1到16）和功率节省的时钟分频器（2
i
中：i = 07） 。减少
时钟噪声。
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- 内部地址的跟踪支持，一旦‰的硬件/软件调试。
- JTAG端口。
- 非常低功耗CMOS设计，全静态设计，工作频率下降
直流。
- 停止并等待低功耗待机模式。
片上存储器配置
- 1.5Kx24位Y数据RAM 。
- 1Kx24位X数据RAM 。
- 8Kx24位程序ROM 。
- 0.5Kx24位程序RAM和192x24位引导ROM 。
- 选自Y数据RAM 0.75Kx24位可以被切换到程序RAM导致高达
1.25Kx24位的程序RAM 。
片外存储器扩展
- 外部内存扩展端口具有8位数据总线。
- 片外扩展到数据存储器使用DRAM时， 2× 16M ×8位字。
- 片外扩展到数据存储器采用SRAM时， 2× 256K ×8位字。
- 同步无缝连接SRAM和DRAM 。
外设模块
摩托罗拉
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DSP56364
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