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ATV2500B
描述
该ATV2500Bs在提供最高密度可编程逻辑器件
40或44引脚封装。随着他们的完全连接的逻辑
阵列和灵活的宏单元结构，高利用率门
是容易得到的。
该ATV2500Bs是围绕一个组织
一个通用的
与或阵列。
所有的引脚和反馈方面始终可用
能够每宏。每38逻辑引脚排列
输入口，分别为触发器的输出。
在ATV2500Bs ， 4项产品被输入到每一个
和项。此外，每个宏单元的3和项
可以被组合以提供高达12个乘积项
和项与
没有任何性能损失
。每个触发器是
单独的可选择的是或者D-或T型，提供
进一步的逻辑压实。另外，触发器24可以是
旁路以提供内部组合反馈到
逻辑阵列。
产品方面提供个性化的时钟和同步
复位为每个触发器。触发器也可以是individu-
盟友配置为直接输入引脚的时钟。每个输出
放有它自己的实现乘积项。八同步
预设的乘积项服务于本地组四个或
八个触发器。寄存器预载功能被提供给
简化测试。所有寄存器自动复位时
电。
几个低功率设备选项允许选择的
对于很多功耗敏感的应用的最佳解决方案。
每个选项显著降低系统
动力并提高系统的可靠性。
功能逻辑图说明
该ATV2500B功能逻辑图描述了
的输入端之间的互连，反馈引脚和
逻辑单元。所有的互连通过赎罪路由
GLE全局总线。
该ATV2500Bs很简单，统一的可编程逻辑器件。
24宏单元编号为0到23的每个巨
rocell包含17门。所有与门有172
输入。五较低的产品方面提供AR1 ， CK1 ，
CK2 ， AR2和OE 。它们是： 1异步复位
和每触发器的时钟，和一个输出使能。前12名
乘积项被分为三个总和而言，这是
使用如图所示的宏蜂窝图。
八个同步预置条件分布在2/4巳
燕鸥。前四个宏单元共享预设为0，接下来的两
共享预置1 ，依此类推，最后2宏观结束
单元共享预设7 。
14个专用输入和它们的补用
在全局总线编号的位置，如图所示。每
宏提供了六个输入到全局总线： （左到
右） F2反馈
(1)
真与假，触发器Q1真实，
假的，并且销真假。所占据的位置
在全局总线，这些信号都是在六个数
公交车图旁边的每个宏。
注意：
1.可以在触发器的输入（D / T 2 ）或输出（Q 2 ）可
被反馈的ATV2500Bs 。
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