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VV5410 & VV6410
介绍
SDA
CLKI
RESETB
OEB
图片
格式
曝光
控制
OFFSET
取消
串行
接口
SCL
D[4:0]
产量
Y-
解码器
QCK
LST
FST
数字逻辑
模拟核心
光电二极管
ARRAY
格式
列ADC
VREGS ，
读
结构
音频放大器。 ，
& REFS
X解码器
SRAM网上商店
图1：框图VV5410 / VV6410图像传感器（ 5线输出）
2.3.1
数字数据总线
随着像素数据，分别代表开始和字段的结束和开始和线路的端部的代码被嵌入内
视频数据流，以允许协处理器与视频数据的相机模块生成同步。第8节定义
格式的输出视频数据流。
2.3.2
图像采集卡的控制信号
为了配合嵌入式控制序列数据的资格时钟（ QCK ） ，该行启动信号（ LST）和场开始
信号（FST）的信号可以独立地设置，如下所示：
1.禁用
2.自由运行。
3.只有资格的控制序列和像素数据。
4.资格仅在像素数据
也有两种不同的QCK频率的选择，其中一个两倍于其他的频率。
1.快速QCK ：在时钟的下降沿对外贸易资质科幻上课每8,5或4位的数据，构成了一个像素值的块。
2.慢QCK ：上升沿数据的对外贸易资质科幻上课第一，第三，第五等的块，使一个像素值，而下降沿寻求专业
科幻ES数据的第2 ，第4 ，第6块等。例如，在4线模式，时钟对外贸易资质科幻ES最显Fi的上升沿
着半字节而时钟对外贸易资质科幻ES是最显着的半字节的下降沿。
2.3.3
2线串行接口
2线串行接口提供了完整的控制，传感器设置和操作。两个串行接口的广播地址
被支持。一允许所有传感器被写入到在平行而另一允许的所有传感器和协处理器将要写入
向平行。
第9章定义串行接口通信协议和所有位置的寄存器映射可接
通过串行接口。
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cd5410-6410f-3-0.fm
商业机密
