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电气特性
时序图
时序图
t
PCLK
CS
t
领导
t
WSCLKh
t
LAG
SCLK
t
WSCLKl
t
SISU
t
SIH
MOSI
未定义
t
有效
t
SOEN
迪0
不在乎
DI 8
不在乎
t
SODIS
MISO
做0
做8
在MOSI引脚输入的数据是由33742在SCLK的下降沿进行采样。在MISO引脚输出的数据
由33742设定在SCLK的上升沿(后吨
有效
延迟时间)。
图7. SPI时序图
t
LRD
t
TRD
TXD
0.8 V
2.0 V
TXD
0.8 V
t
LDR
2.0 V
t
TDR
V
差异
0.9 V
0.5 V
V
差异
= V
CANH
- V
CANL
RXD
0.8 V
2.0 V
图9.传播延迟TXD到CAN
图8.传输环路延迟TXD到RXD
V
差异
0.9 V
t
RRD
t
RDR
0.5 V
RXD
0.8 V
2.0 V
图10.传播延迟到RXD
33742
22
模拟集成电路设备数据
飞思卡尔半导体公司

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