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ST7LITE1xB
7.5 RESET序列管理器（ RSM ）
7.5.1简介
复位序列管理包括三个RE-
SET源所示
图16：
■
外部复位源脉
■
内部LVD复位（低电压检测）
■
内部看门狗复位
注意：
复位也可以触发继
检测非法操作码或prebyte代码。重
FER到
107页的第12.2.1
为进一步DE-
尾巴。
这些源作用于RESET引脚，它是AL-
如何保持在较低的延迟期。
在RESET服务程序向量固定为AD-
礼服FFFEH - FFFFh时在ST7存储器映射。
基本复位序列由3个阶段
如图
图15：
■
根据复位源活跃期
■
256或4096的CPU时钟周期的延迟（见表
如下图）
■
复位向量取
注意事项：
当ST7是未编程或完全
擦除时， Flash是空白，复位向量
不编程。出于这个原因，它是中建议
谁料想保持低电平状态的RESET引脚直至
进入编程模式，以避免
不必要的行为。
256或4096的CPU时钟周期的延迟使得
振荡器以稳定并确保恢复
已经发生的复位状态。短
以上的时钟周期的延迟会自动选择 -
编取决于时钟源选择由掩膜
化的字节：
复位向量取指阶段持续时间为2个时钟
周期。
时钟源
内部RC振荡器
外部时钟（连接到CLKIN引脚）
外部晶体/陶瓷振荡器
（连接到OSC1 / OSC2引脚）
CPU时钟
周期延迟
256
256
4096
如果PLL通过选项字节使能，输出
后T的附加延迟的时钟
启动
（见
图13）。
图15.复位序列相
RESET
活跃期
内部复位
256或4096个时钟周期
取
向量
7.5.2异步外部复位引脚
RESET引脚既是输入和开漏
集成右输出
ON
弱上拉电阻。
这种上拉没有固定的值，但不同的AC-
cordance与输入电压。它可拉
低通过外部电路向复位器件。看
电气特性一节的更多细节。
复位信号由外部发起
源必须具有至少吨的持续时间
H（ RSTL ）在
in
责令被认可（见
图17）。
这DE-
tection是异步的，因此，在MCU
可以进入，即使在HALT模式复位状态。
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