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输入/输出（ I / O）端口
DDRA [ 7 ： 0 ] - 数据方向寄存器A位
这些读/写位控制端口A的数据方向。复位清零DDRA [ 7 ： 0 ] ，配置所有端口引脚
作为输入。
1 =相应端口A引脚配置为输出
0 =相应端口A引脚CON组fi gured作为输入
记
通过写端口之前的数据寄存器避免对A端口引脚故障
不断变化的数据方向寄存器A位从0到1 。
图16-4
显示端口A的I / O逻辑。
READ DDRA （$ 0004）
写DDRA （$ 0004）
内部数据总线
RESET
写PTA （$ 0000）
PTAx
PTAx
DDRAx
READ PTA （$ 0000）
图16-4 。端口A的I / O电路
当DDRAx是逻辑1时，读取地址0000美元读取PTAx数据锁存器。当DDRAx是逻辑0时，
读取地址0000美元读取引脚上的电平。数据锁存器可以始终写入
不管其数据方向位的状态。
表16-2
总结的A端口引脚的操作。
表16-2 。端口A引脚功能
DDRA
位
0
1
访问到DDRA
PTA位
X
(1)
X
I / O引脚模式
读/写
输入，高阻
(2)
产量
DDRA [7 ：0]的
DDRA [7 ：0]的
读
针
PTA [7：0 ]
写
PTA [7：0 ]
(3)
PTA [7：0 ]
存取PTA
1， X =无关。
2.高阻=高阻抗。
3.写作影响数据寄存器，但不影响输入。
MC68HC908AP A-系列数据手册，第2版
258
飞思卡尔半导体公司
