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CS42L51
联合DAC插值&片上模拟滤波器响应
参数
（注12 ）
频率响应10 Hz到20 kHz
通带
阻
阻带衰减
（注13 ）
群时延
去加重错误
FS = 32千赫
FS = 44.1千赫
FS = 48千赫
到-0.05 dB转折
至-3 dB转折
民
-0.01
0
0
0.5465
50
-
-
-
-
典型值
-
-
-
-
-
10.4/Fs
-
-
-
最大
+0.08
0.4780
0.4996
-
-
-
+1.5/+0
+0.05/-0.25
-0.2/-0.4
单位
dB
Fs
Fs
Fs
dB
s
dB
dB
dB
注意事项：
12.响应是时钟依赖，并会规模的FS。注意，该响应曲线（图
38
to
图41
在82页）
已被归一化到Fs和可去归一化由Fs的乘X轴刻度。
13.测量带宽是从阻带至3 Fs的。
切换规格 - 串行端口
（输入：逻辑0 = DGND ，逻辑1 = VL ， SDOUT
负载
= 15 pF的。 ）
参数
RESET
引脚为低电平脉宽
MCLK频率
MCLK占空比
（注15 ）
（注14 ）
符号
民
1
1.024
45
最大
-
38.4
55
单位
ms
兆赫
%
从模式
输入采样率（ LRCK ）
四分之一速率模式
半速模式
单速模式
倍速模式
F
s
F
s
F
s
F
s
1/t
P
t
S（ LK- SK ）
t
D（ MSB）中
t
S（ SDO - SK ）
t
H（ SK- SDO ）
t
S（ SD- SK ）
t
h
4
8
4
50
45
-
45
40
-
20
30
20
20
12.5
25
50
100
55
64F
s
55
-
52
-
-
-
-
千赫
千赫
千赫
千赫
%
Hz
%
ns
ns
ns
ns
ns
ns
LRCK占空比
SCLK频率
SCLK占空比
LRCK建立时间SCLK上升沿之前
LRCK边到SDOUT MSB输出延迟
SDOUT建立时间SCLK上升沿之前
SDOUT保持时间SCLK上升沿后
前SCLK上升沿SDIN建立时间
后SCLK上升沿SDIN保持时间
20
DS679F1
