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总线信号配时
所有输出引脚上的MPC860有快速的上升和下降时间。印刷电路（ PC）的互连走线长度应
为了降低下冲引起的这些快速输出的切换时间的反射最小化。这
建议特别适用于地址总线和数据总线。 6英寸最大PC走线长度
推荐使用。电容的计算应考虑所有设备的负载，以及寄生电容因
PC痕迹。注意合理的PCB布局和旁路成为具有较高的系统尤其重要
容性负载，因为这些负载创建在V高瞬态电流
CC
和GND电路。拉起所有未使用
输入或信号，就可以在复位期间输入。特别应注意尽量减少对噪声水平
PLL电源引脚。
9
总线信号配时
表7
提供了MPC860在33所述的总线操作的时序，40， 50 ，和66兆赫。
通过MPC860支持的最大总线速度为66兆赫。更高速度的部件，必须在半速下操作
总线模式（例如，在80MHz的使用一个MPC860必须为40MHz的总线来配置） 。
所显示的MPC860总线时序假设一个50 pF负载的最大延迟和一个0 - pF负载最小
延误。
表7.总线操作时序
33兆赫
NUM
特征
民
B1
B1a
B1b
B1c
B1d
B1e
B1f
B1g
B1h
B2
B3
B4
B5
33
B7
CLKOUT周期
EXTCLK到CLKOUT相位偏移
（ EXTCLK > 15 MHz和MF < = 2 ）
EXTCLK到CLKOUT相位偏移
（ EXTCLK > 10 MHz和MF < 10 ）
CLKOUT相位抖动（ EXTCLK >
15兆赫和MF < = 2）的
1
CLKOUT相位抖动
1
CLKOUT频率抖动（ MF < 10 ）
1
CLKOUT频率抖动（ 10 < MF
< 500 ）
1
CLKOUT频率抖动（ MF > 500 ）
1
40 MHZ
民
25.00
–0.90
–2.30
–0.60
–2.00
—
—
—
—
10.00
10.00
—
—
6.25
最大
30.30
0.90
2.30
0.60
2.00
0.50
2.00
3.00
0.50
—
—
4.00
4.00
—
50兆赫
民
20.00
–0.90
–2.30
–0.60
–2.00
—
—
—
—
8.00
8.00
—
—
5.00
最大
30.30
0.90
2.30
0.60
2.00
0.50
2.00
3.00
0.50
—
—
4.00
4.00
—
66兆赫
单位
民
15.15
–0.90
–2.30
–0.60
–2.00
—
—
—
—
6.06
6.06
—
—
3.80
最大
30.30
0.90
2.30
0.60
2.00
0.50
2.00
3.00
0.50
—
—
4.00
4.00
—
ns
ns
ns
ns
ns
%
%
%
%
ns
ns
ns
ns
ns
最大
30.30
0.90
2.30
0.60
2.00
0.50
2.00
3.00
0.50
—
—
4.00
4.00
—
30.30
–0.90
–2.30
–0.60
–2.00
—
—
—
—
12.12
12.12
—
—
7.58
在EXTCLK频率抖动
CLKOUT脉冲宽度低
CLKOUT宽高
CLKOUT上升时间
3
CLKOUT下降时间
3
2
CLKOUT为A（ 0:31 ） ， BADDR （ 28:30 ）
RD / WR ，连拍， D（ 0:31 ） ， DP （ 0 ： 3 ）
无效
MPC860系列硬件规格，版本7
12
飞思卡尔半导体公司
