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IDT723654 / 723674分之723664 CMOS SyncBiFIFO
TM
具有总线匹配
2048 ×36× 2 4096 ×36× 2和8192 ×36× 2
商业级温度范围
t
CLK
t
CLKH
CLKA
CSA
W / RA
工商管理硕士
ENA
全民教育
A0-A35
CLKB
FFB
CSB
W / RB
MBB
t
ENS2
ENB
t
DS
B0-B35
写
到FIFO2
5608 drw24
t
CLKL
低
低
低
t
ENS2
t
ENH
高
t
A
下一个字从FIFO2
上一个单词FIFO2输出寄存器
t
SKEW1
(1)
t
CLKH
1
t
CLK
t
CLKL
2
t
WFF
t
WFF
FIFO2全部
低
低
t
ENS2
t
ENH
t
ENH
t
DH
注意事项：
1. t
SKEW1
是上升CLKA边缘，上升CLKB边缘的之间的最小时间
FFB
变为高电平，在未来CLKB周期。如果上升CLKA边缘，上升之间的时间
CLKB边缘小于吨
SKEW1
，然后
FFB
可以转换高一CLKB周期晚于所示。
2.如果端口B的大小是字或字节，
FFB
置为低电平以长字的最后一个字或字节写入，分别。
图22 。
FFB
旗时间和第一个可用的时候写FIFO2已满（ IDT标准模式）
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