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IDT723654 / 723674分之723664 CMOS SyncBiFIFO
TM
具有总线匹配
2048 ×36× 2 4096 ×36× 2和8192 ×36× 2
CLKA
CLKB
t
RSTS
MRS1
t
BES
BE / FWFT
t
FSS
FS2,
FS1,FS0
t
WFF
FFA / IRA
t
REF （3）
EFB / ORB
t
RSF
AEB
t
RSF
AFA
t
RSF
MBF1
RTM
低
0,1
BE
t
FSH
t
BEH
t
RSTH
商业级温度范围
t
FWS
FWFT
t
WFF
5608 DRW 05
注意事项：
1. FIFO2的主复位（ MRS2 ）被以相同的方式进行装载X2和Y2与预先设定的值。对于FIFO2主复位，
MRS1
必须同时具有切换
MRS2.
2.
PRS1
必须在主复位高。
3.如果BE / FWFT高，则
EFB / ORB
将变为低电平1 CLKB周期早于在这种情况下，其中BE / FWFT为LOW 。
图3. FIFO1主复位和加载X1和Y1与八预设值
(1)
（ IDT标准和FWFT模式）
CLKA
CLKB
t
RSTS
PRS1
t
WFF
FFA / IRA
t
REF(3)
EFB / ORB
t
RSF
AEB
t
RSF
AFA
t
RSF
MBF1
RTM
低
5608 DRW 06
t
RSTH
t
WFF
注意事项：
1.偏Reset被以相同的方式对FIFO2的执行。
2.
MRS1
必须是在部分复位高。
3.如果BE / FWFT高，则
EFB / ORB
将变为低电平1 CLKB周期早于在这种情况下，其中BE / FWFT为LOW 。
图4. FIFO1部分复位
(1)
（ IDT标准和FWFT模式）
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