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ICS8535BI-01
低偏移， 1至4 LVCMOS / LVTTL - TO- 3.3V的LVPECL扇出缓冲器
初步
A
PPLICATION
I
载文信息
R
ECOMMENDATIONS FOR
U
NUSED
I
NPUT和
O
安输出
P
插件
I
NPUTS
:
CLK我
NPUTS
如果不需要利用一个时钟输入端，它可以是
悬空。虽然不是必需的，但对于额外的保护，一
1kΩ电阻可以从CLK输入端对地被捆绑。
LVCMOS
ONTROL
P
插件
所有的控制引脚具有内部上拉或下拉功能;另外
不需要性，但可以额外添加
保护。一个1kΩ电阻都可以使用。
O
UTPUTS
:
LVPECL
UTPUTS
所有未使用的LVPECL输出可以悬空。我们建议
没有一丝连接。差分输出的两侧
一双要么悬空或终止。
T
发芽FOR
LVPECL
UTPUTS
下面示出的时钟布局拓扑结构是一个典型的终止
对于LVPECL输出。提到的两个不同的布局是
建议仅作为指导。
FOUT和nFOUT低阻抗跟随输出， gen-
中心提供全方位ECL / LVPECL兼容的输出。因此，终止
电阻器（直流电流路径接地）或电流源必须是
用于功能性。这些输出设计用于驱动50Ω
传输线。匹配阻抗技术应该是
用来最大限度地提高工作频率，并最大限度地减少信号显示
失真。
图2A和2B
显示两个不同的布局有哪些
建议仅作为指导。其它合适的时钟布局
可能存在的，它会建议理事会设计 -
ERS模拟，以保证在所有的印刷电路兼容
和时钟组件的工艺变化。
3.3V
Z
o
= 50Ω
FOUT
鳍
125Ω
Z
o
= 50Ω
FOUT
50Ω
50Ω
V
CC
- 2V
RTT
125Ω
Z
o
= 50Ω
鳍
Z
o
= 50Ω
84Ω
84Ω
RTT =
1
Z
((V
OH
+ V
OL
) / (V
CC
– 2)) – 2
o
F
IGURE
2A 。 LVPECL
安输出
T
发芽
F
IGURE
2B 。 LVPECL
安输出
T
发芽
IDT
/ ICS
3.3V的LVPECL扇出缓冲器
8
ICS8535BGI -01 REV 。一2007年11月9日
