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ICS853111B
低偏移， 1到10 ，差分至2.5V ， 3.3V LVPECL / ECL扇出缓冲器
LVPECL
LOCK
I
NPUT
I
覆盖整个院落
在PCLK / nPCLK接受LVPECL ， CML ， SSTL等
差分信号。双方V
摇摆
和V
OH
必须满足V
PP
和
V
CMR
输入要求。
图3A到3E
显示接口
示例， HiPerClockS PCLK / nPCLK输入的驱动
最常见的驱动程序类型。输入接口建议
这里仅是例子。如果驱动程序是从其他供应商，
使用他们的终端建议。请与咨询
所述驱动器部件的供应商以确认驱动器端接
要求。
3.3V
3.3V
CML
ZO = 50欧姆
3.3V
R1
50
R2
50
PCLK
ZO = 50欧姆
NPCLK
HiPerClockS
PCLK / nPCLK
2.5V
SSTL
ZO = 60欧姆
2.5V
3.3V
R3
120
R4
120
PCLK
ZO = 60欧姆
NPCLK
R1
120
R2
120
HiPerClockS
PCLK / nPCLK
F
IGURE
4A 。
I
P
ER
C
LOCK
S PCLK / nPCLK我
NPUT
D
四分五裂
通过
CML
河
F
IGURE
3B 。
I
P
ER
C
LOCK
S PCLK / nPCLK我
NPUT
D
四分五裂
通过
SSTL
河
3.3V
3.3V
ZO = 50欧姆
R3
125
R4
125
3.3V
3.3V
3.3V
LVDS
ZO = 50欧姆
C1
R5
100
R3
1K
R4
1K
3.3V
PCLK
ZO = 50欧姆
NPCLK
LVPECL
R1
84
R2
84
HiPerClockS
输入
ZO = 50欧姆
R1
1K
R2
1K
C2
PCLK
NPCLK
HiPerClockS
PCL K / N PC LK
F
IGURE
3C 。
I
P
ER
C
LOCK
S PCLK / nPCLK我
NPUT
D
四分五裂
通过
3.3V LVPECL
河
F
IGURE
3D 。
I
P
ER
C
LOCK
S PCLK / nPCLK我
NPUT
D
四分五裂
通过
3.3V LVDS
河
3.3V
3.3V
3.3V LVPECL
ZO = 50欧姆
C1
3.3V
R3
84
R4
84
PCLK
ZO = 50欧姆
C2
NPCLK
R5
100 - 200
R6
100 - 200
R1
125
R2
125
HiPerClockS
PCLK / nPCLK
F
IGURE
3E 。
I
P
ER
C
LOCK
S PCLK / nPCLK我
NPUT
D
四分五裂
通过
3.3V LVPECL
河流
AC - C
OUPLE
IDT
/ ICS
1到10 ， LVPECL / ECL扇出缓冲器
9
ICS853111BY REV 。 B 2007年9月5日
