
初步数据表 SKY73101 VCO /合成器
表2. CLK , DATA , LE预设时序参数
参数
输入高电压(V
IH
)
低输入电压(V
IL
)
输入电流(L
DIG
)
时钟频率
钟高(T
长实
)
时钟低(T
CKL
)
数据设置(T
DSU
)
数据保持(T
DHD
)
时钟锁存使能(吨
CLE
)
锁存使能的宽度(T
LEW
)
锁存使能时钟(T
LEC
)
字长
词数
漏电流
1.6 V
0.3 V
1
A
(最大)
15兆赫(最大)
15纳秒(最低)
15纳秒(最低)
20纳秒(最低)
10纳秒(最低)
20纳秒(最低)
15纳秒(最低)
15纳秒(最低)
26位
4
2
A
价值
POWER- ON
预设
CLK
数据
( 0-3个字,位[ 25 : 0 ] )
负载
注册
位[ 25 :2]
手术
模式
注册
LATCH
WORD 0
位[ 25 :2]
AUTO
校准
控制
注册
LATCH
WORD 1
位[ 25 :2]
频率
WORD 2
位[ 25 :2]
控制1
注册
LATCH
频率
控制2
注册
LATCH
WORD 3
位[ 25 :2]
也就是说0-3
比特[1:0 ]
LE
2 LSB解码
(寄存器地址,
比特[1 :0])
S918
图4.串行总线框图
VCO预分频器
该VCO预分频器由16/17或者除以VCO输出信号
或8/9 。该
Σ
调制器确定由16或分
17 ,在16/17模式,或者是否通过8或9中的8/9分
模式。
N-二计数器
N型计数器由两个异步脉冲计数器,一个
6位M-计数器和一个4位A计数器。对M-计数器确定
使用较低的分频比的分频器( 8或16 )的数量;
在A柜台决定了使用上的分频比计数
( 9或17)。
通过改变计数器的设定在每一个参考时钟周期,则
调制分数分频器( MFD )达到所需的噪声
塑造。
VCO MFD座
在MFD模块分频器对预分频器输出相位
锁相环( PLL)的参考频率。三阶级联
Σ
调制技术,通过随机最大限度地减少杂散
的分频比。
在MFD模块控制,通过动态的分频比
编程M和一个计数器在N计数器。
鉴相器和电荷泵
相位检测器和电荷泵检测和集成
下分频VCO的输出的相位和频率误差
相对于所述参考时钟。这导致反馈调整
控制电压为VCO的。
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