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ISL12028
串行接口（I
2
C）规格
（续）
符号
t
IN
t
AA
参数
脉冲宽度抑制时间
SDA和SCL输入
SCL下降沿到SDA输出
数据有效
时间总线必须是自由前
一个新的传输开始
条件
任何脉冲比最大窄
规范被抑制。
SCL下降沿穿越30 ％
V
DD
直到SDA退出30 ％至70％
V的
DD
窗口。
SDA渡V的70 ％
DD
期间
停止条件，以SDA道口
V 70 ％
DD
下面的过程
启动条件。
测量V的30 ％
DD
道口。
测量V的70 ％
DD
道口。
SCL上升沿到SDA下降沿。
两个过路的V 70 ％
DD
.
从SDA下降沿穿越30 ％
V的
DD
到SCL下降沿穿越
V 70 ％
DD
.
从SDA退出的30％至70％
V
DD
窗口，以SCL上升沿
穿越的V 30 ％
DD
从SCL下降沿穿越70 ％
V的
DD
到的SDA进入30％至
V 70 ％
DD
窗口。
从SCL上升沿穿越70 ％
V的
DD
到SDA上升沿交叉
Ⅴ的30％的
DD
.
从SDA上升沿SCL下降
边缘。两个过路的V 70 ％
DD
.
从SCL下降沿穿越30 ％
V的
DD
直到SDA进入30％至
V 70 ％
DD
窗口。
从30％到V的70％
DD
从70％到V的30％
DD
1300
民
典型值
最大
50
900
单位
ns
ns
笔记
t
BUF
ns
t
低
t
高
t
SU ： STA
t
高清： STA
时钟低电平时间
时钟高电平时间
启动条件建立时间
START条件保持时间
1300
600
600
600
ns
ns
ns
ns
t
苏： DAT
输入数据建立时间
100
ns
t
高清： DAT
输入数据保持时间
0
ns
t
苏： STO
停止条件的建立时间
600
ns
t
高清： STO
t
DH
停止条件保持时间
阅读，或挥发性只写
输出数据保持时间
600
0
ns
ns
t
R
t
F
Cb
CPIN
t
WC
注意事项：
SDA和SCL上升时间
SDA和SCL下降时间
20 +
0.1× Cb的
20 +
0.1× Cb的
10
250
250
400
10
12
20
ns
ns
pF
pF
ms
10
电容式SDA或SCL总片上和片外的装载
SDA ， SCL和电容引脚
非易失性写周期时间
3. IRQ /女
OUT
无效（没有频率输出，无报警） 。
4. V
IL
= V
DD
X 0.1 ，V
IH
= V
DD
×0.9 ，女
SCL
= 400kHz的。
5. V
RESET
= 2.63V (V
DD
必须大于V
RESET
), V
BAT
= 0V.
6位BSW = 0 （标准模式） ，V
BAT
≥
1.8V.
7.指定在+ 25°C 。
8.为了确保适当的计时，在V
SR- DD
规范必须遵守。
9.参数不是100 ％测试。
10. t
WC
是被允许为任何非易失性写入由用户的最小周期时间，它是从有效的停止条件时，在写入结束时
序列中的串行接口写入操作，以在自定时内部非易失性写周期的结束。
6
FN8233.5
二〇〇六年十月十八日
