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ADT7461A
SMBUS时序规范
表3中。
参数
1
f
SCLK
t
低
t
高
t
R
t
F
t
SU ; STA
t
HD ; STA 2
t
SU ; DAT 3
t
SU ;申通快递4
t
BUF
T
在T限制
民
和T
最大
400
1.3
0.6
300
300
600
600
100
600
1.3
单位
kHz的最大
微秒分钟
微秒分钟
ns（最大值）
ns（最大值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
微秒分钟
描述
时钟低电平时间，在10个百分点
时钟高电平期间，与90 ％分
时钟/数据上升时间
时钟/数据下降时间
启动条件建立时间
START条件保持时间
数据建立时间
停止条件的建立时间
停止和启动条件之间的总线空闲时间
1
2
通过设计保证，但未经生产测试。
时间从SDATA的10 ％至90％的SCLK 。
3
时间为10 ％或90％ SDATA至SCLK的10％。
4
时间的90％的SCLK到SDATA的10％。
时序图
t
低
SCLK
t
R
t
F
t
HD ; STA
t
HD ; STA
t
HD ; DAT
SDATA
t
高
t
SU ; DAT
t
SU ; STA
t
SU ; STO
停止启动
开始
停止
图2.串行总线时序
版本A |第24 5
05571-002
t
BUF
