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CY2314ANZ
应用信息
时钟迹线必须用串联或并联终止被终止，如通常进行。
应用电路
R
s
CPUCLK
PCICLK
USBCLK
REF
APIC
BUF_IN
R
s
SDATA
SCLK
V
DD
3.3V
C
t
V
DD
SDATA
SCLK
SDRAM （ 0-13 ）
SDRAM （ 0-13 ）
* CY2280 48引脚SSOP
（或CY2281或CY2282 ）
C
d
0.1uF
V
SS
CY2314ANZ ：
引脚SOIC
CY2314 28
28引脚SOIC
*该频率合成器TO
GENERATE CPU ， PCI ， USB ，楼盘，和APIC时钟。
C
d
= DECOUP凌电容S
C
t
=可选的EMI -R EDUCING CAP ACI TORS
R
s
= SERIES终端电阻
摘要
表面贴装，低ESR的陶瓷电容应该用于过滤。典型地，这些电容具有0.1的值
F.
在某些情况下，更小的值的电容器，可能需要。
串联端接电阻器的值满足下面的等式，其中RTRACE是装载特性阻抗
迹线，路特是缓冲液（通常为25Ω ）的输出阻抗，并且RSERIES是串联端接电阻。
RSERIES > RTRACE - 溃败
脚印必须奠定了可选的EMI降低电容，应尽可能靠近终端电阻
因为是身体可能。这些电容的典型值的范围从4.7 pF到22 pF的。
铁氧体磁珠
五月
用于分离管理局V
DD
来自时钟发生器V
DD
岛上。确保铁氧体磁珠提供
大于50Ω阻抗的时钟频率，根据负载的DC条件下更大。请参考应用笔记“布局
和赛普拉斯时钟发生器“的更多细节端接技术。
如果一个铁氧体磁珠时，有10
F–22 F
钽旁路电容应放置在靠近铁氧体磁珠。该电容
防止电源电压下降时电流浪涌。
订购信息
订购代码
CY2314ANZSC-1
包
名字
S28
套餐类型
28引脚SOIC
操作
范围
广告
文件编号： 38-07143修订版**
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